[发明专利]低功率双纠错－三检错(DEB-TED)解码器有效
| 申请号： | 201680052581.0 | 申请日： | 2016-08-25 |
| 公开（公告）号： | CN108055876B | 公开（公告）日： | 2022-11-18 |
| 发明（设计）人： | S-O·郑;S·崔;B·K·宋;T·那;J·金;J·P·金;S·金;T·金;S·H·康 | 申请（专利权）人： | 高通股份有限公司;延世大学校产学协力团 |
| 主分类号： | H03M13/15 | 分类号： | H03M13/15;G06F11/10;H03M13/00 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 陈炜;袁逸 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 检错和纠错解码装置根据数据输入是包含单比特差错还是多比特差错来执行单纠错－双检错(SEC‑DED)或双纠错－三检错(DEC‑TED)，以在单比特差错的情况下降低功耗和等待时间，而在多比特差错的情况下提供强大的纠错。 | ||
| 搜索关键词： | 功率 纠错 检错 deb ted 解码器 | ||
【主权项】：
1.一种检错和纠错装置，包括：单差错位置解码器，其被配置为定位在输入数据中的单差错；双差错位置解码器，其被配置为定位在所述输入数据中的双差错；以及纠错器，其被耦合到所述单差错位置解码器和所述双差错位置解码器以生成经纠正的输出数据。
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