[发明专利]一种提高钴阻挡层沉积选择比的方法有效
申请号: | 201410427394.9 | 申请日: | 2014-08-27 |
公开(公告)号: | CN104152863B | 公开(公告)日: | 2019-10-25 |
发明(设计)人: | 雷通 | 申请(专利权)人: | 上海华力微电子有限公司 |
主分类号: | C23C16/04 | 分类号: | C23C16/04;C23C16/06;H01L21/205 |
代理公司: | 上海天辰知识产权代理事务所(特殊普通合伙) 31275 | 代理人: | 吴世华;林彦之 |
地址: | 201210 上海市浦*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 一种 提高 阻挡 沉积 选择 方法 | ||
1.一种提高钴阻挡层沉积选择比的方法,用于集成电路后段工艺中铜扩散阻挡层的制作,其特征在于,包括以下步骤:
步骤一:提供一晶圆,所述晶圆表面具有多孔low k介质层,所述多孔low k介质层布有铜互连线,并经过平坦化处理;
步骤二:采用直接光CVD工艺,在所述多孔low k介质层表层的孔隙中选择性沉积一层二氧化硅,即在多孔low k介质层表层的孔隙内填充了二氧化硅,形成致密化的所述多孔low k介质层的表层;其中,在沉积过程中,首先通入SiH4气体,SiH4分子得以进入多孔low k介质层的孔隙,并被吸附在多孔low k介质层的表层,然后通入N2O气体,同时,打开低压汞灯,使N2O解离,并氧化SiH4,从而形成二氧化硅;
步骤三:对所述晶圆表面进行清洗;
步骤四:采用CVD工艺在所述多孔low k介质层上选择性沉积钴阻挡层,以在所述铜互连线上形成铜扩散阻挡层。
2.根据权利要求1所述的提高钴阻挡层沉积选择比的方法,其特征在于,步骤二中,在进行所述直接光CVD工艺时,所述多孔low k介质层的温度为200~400℃。
3.根据权利要求1所述的提高钴阻挡层沉积选择比的方法,其特征在于,步骤二中,在进行所述直接光CVD工艺时,紫外光的波长为175~195nm。
4.根据权利要求1~3任意一项所述的提高钴阻挡层沉积选择比的方法,其特征在于,步骤二中,进行所述直接光CVD工艺的次数为1至多次。
5.根据权利要求4所述的提高钴阻挡层沉积选择比的方法,其特征在于,步骤二中,进行所述直接光CVD工艺的次数为1至3次。
6.根据权利要求5所述的提高钴阻挡层沉积选择比的方法,其特征在于,步骤二中,进行所述直接光CVD工艺的次数为2次。
7.根据权利要求1所述的提高钴阻挡层沉积选择比的方法,其特征在于,步骤四中,采用CVD工艺沉积钴阻挡层时,将所述多孔low k介质层的温度保持在不低于250℃。
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C23C16-00 通过气态化合物分解且表面材料的反应产物不留存于镀层中的化学镀覆,例如化学气相沉积
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