[发明专利]用于顺序脉冲串方式的同步动态随机存取存储器结构无效
| 申请号： | 98125593.0 | 申请日： | 1998-12-17 |
| 公开（公告）号： | CN1231479A | 公开（公告）日： | 1999-10-13 |
| 发明（设计）人： | 卡尔·P·普费弗 | 申请（专利权）人： | 西门子公司 |
| 主分类号： | G11C8/00 | 分类号： | G11C8/00 |
| 代理公司： | 柳沈知识产权律师事务所 | 代理人： | 黄敏 |
| 地址： | 联邦德*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种电子存储器器件,包括一个具有被安置成多个单位的多个存储器单位的存储器阵列。每个单位被分成只包括偶数编址存储器单位的第一部分和只包括奇数编址存储器单位的第二部分,一个列译码器和一个行译码器被耦合到所述存储器阵列上,用于选择多个存储器单位的一些。一个读出放大器被耦合到所述存储器阵列上,用于执行从/向被选择的存储器单位读出/写入操作。一个地址线被分割,用于将所述被分割的地址加到所述偶数和奇数编址的存储器单位上。 | ||
| 搜索关键词： | 用于 顺序 脉冲 方式 同步 动态 随机存取存储器 结构 | ||
【主权项】：
1．一种存储器器件，包括；一个具有多个被安置成多个单位的存储器单位的存储器阵列，其中，所述单位被分成具有偶数编址存储器单位的第一部分和具有奇数编址存储器单位的第二部分；耦合到所述存储器阵列的一个列译码器和一个行译码器，用于选择一定数量的所述多个存储器单位；耦合到所述存储器阵列的一个读出放大器，用于从所述被选择的存储器单位执行读出和写入操作；和经过多个地址线耦合到所述列译码器的多个地址位，所述地址位的至少一个被分割成两个被分割的位，以经过被分割的地址线用于所述偶数和奇数地址存储器单位，其中，在访问存储器期间，所述被分割的位增加，以用于脉冲串方式中的后续顺序访问。
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