[发明专利]具有锁存器和奇偶校验能力的双向缓冲器无效
| 申请号： | 89102936.2 | 申请日： | 1989-05-03 |
| 公开（公告）号： | CN1011556B | 公开（公告）日： | 1991-02-06 |
| 发明（设计）人： | 帕特里克·M·伯兰德;迈克·E·丹尼;吉尼·J·古德茨;凯威·G·克莱默;苏珊·L·坦普斯特 | 申请（专利权）人： | 国际商业机器公司 |
| 主分类号： | G06F13/38 | 分类号： | G06F13/38;G06F13/42 |
| 代理公司： | 中国国际贸易促进委员会专利代理部 | 代理人： | 王以平 |
| 地址： | 美国*** | 国省代码： | 暂无信息 |
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| 摘要： | 对第一和第二数据总线间传送的数字数据作缓冲和奇偶校验的电路，它包括多个双向位缓冲器电路。各双向位缓冲器电路包括由串接在第一和第二数据总线间的数据接收器、输出端接一奇偶校验电路的锁存器和驱动器组成的第一数据通道由串接在第二和第一数据总线间的数据接收器、锁存器和驱动器组成的第二数据通道；控制驱动器以有选择地将驱动器输出端置于有效驱动或高阻状态的控制装置；控制锁存器以有选择地锁存或传送数据的控制装置。 | ||
| 搜索关键词： | 具有 锁存器 奇偶校验 能力 双向 缓冲器 | ||
【主权项】：
1.对在第一和第二数据总线之间传送的数字数据进行缓冲和奇偶校验的设备，包括：一系列双向位缓冲器电路，每一上述双向位缓冲器电路包括第一数据通道和第二数据通道，其中，第一数据通道由输入端连到上述第一数据总线的接收器、输入端连到上述接收器输出端的锁存器和输入端连到上述锁存器输出端而输出端连到上述第二数据总线的驱动器组成；第二数据通道由输入端连到上述第二数据总线的接收器、输入端连到上述接收器输出端的锁存器和输入端连到上述锁存器输出端而输出端连到上述第一数据总线的驱动器组成；其特征在于还包括：控制上述驱动器以便有选择地将上述驱动器的输出端置于有效驱动状态或高阻状态的装置；控制上述数据锁存器以便有选择地锁存数据或传送数据的装置；所述装置的特征在于：连在所述每一双向位缓冲器电路中的第一数据通道锁存器的输出端的用于响应所述第一数据通道锁存器的输出端的数据而产生一奇偶校验信号的奇偶校验产生装置。
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