[发明专利]一种基于分时复用全加器的串行加法器及其运算方法在审
| 申请号： | 202210660379.3 | 申请日： | 2022-06-13 |
| 公开（公告）号： | CN114995781A | 公开（公告）日： | 2022-09-02 |
| 发明（设计）人： | 张扬;陈昭福 | 申请（专利权）人： | 东南大学 |
| 主分类号： | G06F7/501 | 分类号： | G06F7/501;G06F7/504;G06F1/06 |
| 代理公司： | 南京瑞弘专利商标事务所(普通合伙) 32249 | 代理人： | 秦秋星 |
| 地址： | 211189 江*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明提出一种分时复用全加器结构以及基于此全加器的串行加法器设计。目前在全加器设计中普遍采用以异或逻辑为基础；而本方案基于求和信号条件和进位信号条件的相似性，通过钟控管控制MOS电路结构和两套传输门电路结构，以实现分时复用同一个电路结构，来完成求和信号和进位信号的分时输出。此外，总输出信号配合上时钟信号可以将求和信号和进位信号在不同时间段输出。将全加器输出的进位信号，优化并延长其有效时间作为下一加法器计算单位的进位输入信号，则可在下一计算单元中的总输出端获得完整的进位信号。随着进位信号的不断输入，总输出端在优化后可以输出总求和信号。 | ||
| 搜索关键词： | 一种 基于 分时 全加器 串行 加法器 及其 运算 方法 | ||
【主权项】：
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