[发明专利]一种基于FPGA的接收开展频高速V-By-One信号的方法及装置在审
| 申请号： | 202111211287.9 | 申请日： | 2021-10-18 |
| 公开（公告）号： | CN113949831A | 公开（公告）日： | 2022-01-18 |
| 发明（设计）人： | 张朝春 | 申请（专利权）人： | 深圳市视显光电技术有限公司 |
| 主分类号： | H04N5/44 | 分类号： | H04N5/44;H04N5/345;H04N5/347;H04N5/12;H04N19/134;G06F15/78 |
| 代理公司： | 深圳市精英创新知识产权代理有限公司 44740 | 代理人： | 黄文锋 |
| 地址： | 518000 广东省深圳市*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明涉及一种基于FPGA的接收开展频高速V‑By‑One信号的方法及装置；方法，包括：获取经过重新过采样V‑By‑One输入的像素数据；进行数据位切割，得到切割数据及有效数据量；进行数据还原，得到还原数据；进行解码，以得到解码数据；进行字符对齐，得到字符对齐数据；进行数据解扰运算，得到解扰运算数据；进行解包、还原及重组，得到重组像素数据；进行分区重构，以得到分区显示数据；进行像素时钟还原，得到像素时钟信号；驱动像素数据及行场扫描信号输出封包编码，以得到HDMI2.1封包编码数据流；将封包编码数据流输出。本发明解决了无法正常接收开展频的高速信号的缺陷，大大扩宽了FPGA自身的应用范围。 | ||
| 搜索关键词： | 一种 基于 fpga 接收 开展 高速 by one 信号 方法 装置 | ||
【主权项】：
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