[发明专利]用于超高速时域交织ADC的快速收敛时钟偏差校准方法有效
| 申请号： | 202110497136.8 | 申请日： | 2021-05-07 |
| 公开（公告）号： | CN113364460B | 公开（公告）日： | 2023-05-26 |
| 发明（设计）人： | 朱樟明;赵磊;李登全;刘马良;刘术彬;丁瑞雪 | 申请（专利权）人： | 西安电子科技大学 |
| 主分类号： | H03M1/10 | 分类号： | H03M1/10;H03M1/12 |
| 代理公司： | 西安嘉思特知识产权代理事务所(普通合伙) 61230 | 代理人： | 刘长春 |
| 地址： | 710000 陕*** | 国省代码： | 陕西;61 |
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| 摘要： | 本发明涉及一种时钟偏差校准装置、方法及超高速时域交织模数转换器，该时钟偏差校准装置包括：N个探测器、校准控制器、N+1个延迟线和采样电容，其中，探测器的第一输入端输入子模数转换器对应的子通道采样信号，第二输入端与采样电容的一端连接，N个探测器的输出端均与校准控制器的输入端连接，校准控制器的输出端与延迟线的第一输入端连接且校准控制器的输出端输出校准控制逻辑，延迟线的第二输入端与时钟分频器的输出端连接，N+1个延迟线均输出采样时钟以形成N个子模数转换器采样时钟和1个参考通道采样时钟。该时钟偏差校准装置对输入信号无特定要求，控制逻辑简单，收敛速度快，可以达到以较小的代价快速校准时钟偏差的目的。 | ||
| 搜索关键词： | 用于 超高速 时域 交织 adc 快速 收敛 时钟 偏差 校准 方法 | ||
【主权项】：
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