[发明专利]自调谐锁相环(PLL)电路在审

专利信息
申请号: 202110471295.0 申请日: 2021-04-29
公开(公告)号: CN113572472A 公开(公告)日: 2021-10-29
发明(设计)人: W·包米克;B·苏里亚纳拉亚纳;D·阿里姆博尔 申请(专利权)人: 亚德诺半导体国际无限责任公司
主分类号: H03L7/085 分类号: H03L7/085
代理公司: 中国贸促会专利商标事务所有限公司 11038 代理人: 刘倜
地址: 爱尔兰*** 国省代码: 暂无信息
权利要求书: 查看更多 说明书: 查看更多
摘要: 本公开涉及自调谐锁相环(PLL)电路。实施方案可以涉及用于通过锁相环(PLL)电路控制时钟信号的技术或电路。该技术可以包括识别与数字控制振荡器(DCO)的增益有关的第一参数和与时间数字转换器(TDC)的分辨率有关的第二参数。然后,该技术可以包括基于第一参数和第二参数来识别与PLL电路的环路滤波器的滤波器系数有关的第三参数。然后,电路可以基于第一、第二和第三参数输出时钟信号。可以描述或要求保护其他实施方案。
搜索关键词: 调谐 锁相环 pll 电路
【主权项】:
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