[发明专利]一种基于Latch的异步逐次逼近转换逻辑结构在审
| 申请号： | 202110301340.8 | 申请日： | 2021-03-22 |
| 公开（公告）号： | CN113037288A | 公开（公告）日： | 2021-06-25 |
| 发明（设计）人： | 李强;杜宇恒;周雄 | 申请（专利权）人： | 电子科技大学 |
| 主分类号： | H03M1/46 | 分类号： | H03M1/46 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 611731 四川省成*** | 国省代码： | 四川;51 |
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| 摘要： | 异步逐次逼近转换逻辑结构被广泛使用于现今的SAR ADC中，是SAR ADC实现逐次逼近算法的核心模块之一。传统的逻辑结构由于使用了D触发器作为基础元件，所需要的晶体管数量众多，导致该模块的面积与功耗较大。同时大量的数字逻辑翻转所产生的噪声将通过片内寄生耦合到模拟电路模块，影响整个系统的精度。本设计采用Latch结构代替D触发器进行锁存，在大大减少了晶体管数量的同时，通过专门的电路逻辑设计，避免了码字的错误锁存与电容翻转对Latch输出节点的影响，增强了整个系统的可靠性。 | ||
| 搜索关键词： | 一种 基于 latch 异步 逐次 逼近 转换 逻辑 结构 | ||
【主权项】：
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