[发明专利]锁频环电路、低压降稳压器电路及相关方法在审
| 申请号： | 202011081862.3 | 申请日： | 2020-10-12 |
| 公开（公告）号： | CN112653449A | 公开（公告）日： | 2021-04-13 |
| 发明（设计）人： | B·张;A·L·舒克;P·潘蒂 | 申请（专利权）人： | 德克萨斯仪器股份有限公司 |
| 主分类号： | H03L1/00 | 分类号： | H03L1/00;H03L7/085 |
| 代理公司： | 北京纪凯知识产权代理有限公司 11245 | 代理人： | 袁策 |
| 地址： | 美国德*** | 国省代码： | 暂无信息 |
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| 摘要： | 公开了一种锁频环(FLL)电路、低压降稳压器电路以及相关方法。示例门驱动器集成电路(100)包括：第一管芯(102)，该第一管芯(102)包括FLL电路(110A)以生成具有第一相位和第一频率的第一时钟信号(230A)、具有第一频率和不同于第一相位的第二相位的第二时钟信号(230B)，并控制多个开关网络(302、304、306、308)以将第一频率增加到第二频率，并基于第二频率生成反馈电压(232)；以及耦合至第一管芯的第二管芯(104)，第二管芯包括低压降(LDO)电路(148)和驱动器(136)，驱动器被配置为基于第一频率控制晶体管(105)，第二管芯被配置为耦合至晶体管，LDO电路用于基于LDO电路的输出电流满足电流阈值而生成通行门电压。 | ||
| 搜索关键词： | 锁频环 电路 低压 稳压器 相关 方法 | ||
【主权项】：
暂无信息
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