[发明专利]障碍同步电路、障碍同步方法以及并行信息处理装置在审

专利信息
申请号: 202010934575.6 申请日: 2020-09-08
公开(公告)号: CN112486728A 公开(公告)日: 2021-03-12
发明(设计)人: 中川香苗;新井正树;富田安基 申请(专利权)人: 富士通株式会社
主分类号: G06F11/14 分类号: G06F11/14;G06F9/38
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 王伟楠;崔俊红
地址: 日本神*** 国省代码: 暂无信息
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摘要: 提供了障碍同步电路、障碍同步方法以及并行信息处理装置。一种障碍同步电路,其对由多个处理电路并行执行的多个处理执行障碍同步,该障碍同步电路包括:第一确定电路,其被配置成确定多个处理电路中已经完成处理的第一处理电路的数目是否等于或大于第一阈值;以及指示电路,其被配置成在通过第一确定电路确定该数目等于或大于第一阈值的情况下,指示多个处理电路中尚未完成处理的第二处理电路强制停止处理。
搜索关键词: 障碍 同步 电路 方法 以及 并行 信息处理 装置
【主权项】:
暂无信息
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