[发明专利]基于校验子矩阵分割的LDPC编码硬件实现方法有效
| 申请号： | 202010010183.0 | 申请日： | 2020-01-06 |
| 公开（公告）号： | CN111162795B | 公开（公告）日： | 2023-02-03 |
| 发明（设计）人： | 朱胜利;谢玲;王宇舟;张庭兰 | 申请（专利权）人： | 西南电子技术研究所(中国电子科技集团公司第十研究所) |
| 主分类号： | H03M13/11 | 分类号： | H03M13/11 |
| 代理公司： | 成都九鼎天元知识产权代理有限公司 51214 | 代理人： | 罗强 |
| 地址： | 610036 四川*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明公开的一种基于编码子矩阵分割的LDPC编码硬件实现方法，旨在提供一种并行度高，运算量低，可扩展性良好，便于硬件实现的LDPC编码硬件实现方法。本发明通过下述技术方案实现：在FPGA编码时，首先将生成矩阵的校验部分按循环子阵的大小进行列分块，将属于同一子块的循环子阵的首行存储于ROM表中，并作为一个基本编码单元(PE)；编码状态机控制编码子模块PE从ROM表中读出一个数据存入编码移位寄存器，将输入的一比特信息，扩展为与基本编码子阵列数相同的行向量，通过与及异或操作运算，完成了多个一个循环子阵行的校验，基于ROM表的子阵存储以及生成矩阵的分块编码硬件实现编码子矩阵的分割，完成子模块的编码。 | ||
| 搜索关键词： | 基于 校验 矩阵 分割 ldpc 编码 硬件 实现 方法 | ||
【主权项】：
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