[发明专利]一种并行扰码器的生成方法有效

专利信息
申请号: 201911055536.2 申请日: 2019-10-31
公开(公告)号: CN110943955B 公开(公告)日: 2022-06-28
发明(设计)人: 魏星;乐立鹏;安印龙;谢应辉;陈战 申请(专利权)人: 北京时代民芯科技有限公司;北京微电子技术研究所
主分类号: H04L27/26 分类号: H04L27/26;H04J3/06
代理公司: 中国航天科技专利中心 11009 代理人: 徐晓艳
地址: 100076 北*** 国省代码: 北京;11
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摘要: 发明属于电子通信技术领域,涉及一种并行扰码器的生成方法:(1)、根据n位反馈移位寄存器序列生成多项式,得到串行扰码生成器的每个寄存器输出表达式;(2)、以每个寄存器前一个时钟周期的输出作为输入矩阵每个寄存器当前时钟周期的输出作为输出矩阵构建所述串行扰码器矩阵形式;(3)、根据n位串行扰码器的矩阵形式,以前一个时钟周期并行扰码器输出的n位并行扰码为输入矩阵当前时钟周期并行扰码器输出的n位并行扰码得到并行扰码生成器矩阵形式;(4)、根据并行扰码器的矩阵形式,还原得到并行扰码器每个寄存器的输出表达式;(5)、采用硬件描述语言生成相应的逻辑得到并行扰码器代码。本发明计算量小。
搜索关键词: 一种 并行 扰码器 生成 方法
【主权项】:
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