[发明专利]一种极化码译码中路径分裂的硬件排序器系统及设计方法有效
| 申请号： | 201811564209.5 | 申请日： | 2018-12-20 |
| 公开（公告）号： | CN109412609B | 公开（公告）日： | 2020-10-30 |
| 发明（设计）人： | 王家豪;胡振宇;叶敦范;蒋哲栋 | 申请（专利权）人： | 中国地质大学（武汉） |
| 主分类号： | H03M13/13 | 分类号： | H03M13/13 |
| 代理公司： | 武汉知产时代知识产权代理有限公司 42238 | 代理人： | 郝明琴 |
| 地址： | 430000 湖*** | 国省代码： | 湖北;42 |
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| 摘要： | 本发明提出一种极化码译码中路径分裂的硬件排序器系统及设计方法，实施本发明的有益效果是，在极化码译码过程中，对固定比特位的路径不需要排序，因此节省了固定比特位的排序时间；另外只需要在信息比特位进行排序，其排序器的延迟时间与输入的路径数量基本无关，当路径数量较大时仍具有较低的译码延迟率。 | ||
| 搜索关键词： | 一种 极化 译码 路径 分裂 硬件 排序 系统 设计 方法 | ||
【主权项】：
1.一种极化码译码中路径分裂的硬件排序器系统，其特征在于，包括输入模块、桶排序模块、排序器网络模块和输出模块：所述输入模块用于输入待排序的2L条译码路径；所述的译码路径包括L条原始译码路径和L条分裂译码路径，其中L取值为2n，n≥1且n为整数；桶排序模块用于对2L条译码路径进行优劣排序；所述的桶排序模块包括有上桶排序器模块和下桶排序器模块；所述的上桶排序器模块用于对L条原始译码路径进行桶排序，所述的下桶排序器用于将对于L条分裂译码路径进行桶排序，被所述上桶排序器模块排序后的L条原始译码路径和被所述下桶排序器排序后的L条分裂译码路径组成译码路径集合；排序器网络模块，用于根据选择策略，在桶排序模块输出的按优劣排序的译码路径集合中，选择最优的L条路径；输出模块，用于输出经排序器网络模块选择后的最优的L条路径。
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