[发明专利]一种低电阻抗辐照VDMOS芯片的制造方法在审
| 申请号: | 201811202517.3 | 申请日: | 2018-10-16 |
| 公开(公告)号: | CN109559992A | 公开(公告)日: | 2019-04-02 |
| 发明(设计)人: | 朱勤辉;张林;赵星 | 申请(专利权)人: | 江苏万邦微电子有限公司 |
| 主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/28;H01L29/06;H01L29/423;H01L29/51 |
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| 地址: | 210023 江苏省南京市玄武*** | 国省代码: | 江苏;32 |
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| 摘要: | 本发明公开了一种低电阻抗辐照VDMOS芯片的制造方法,该低电阻抗辐照VDMOS芯片的制造方法的具体步骤为:步骤一:材料的选择和清洗:选取N型硅外延片,并对N型硅外延片进行清洗,N型硅外延片为N+区;步骤二:缓冲层和N‑区的形成:先在N型硅外延片表面积淀一层半导体缓冲层,再在半导体缓冲层上积淀一层多晶硅,即N‑区;步骤三:在N‑区的顶部左右两侧刻蚀掉相应位置的多晶硅,形成P基区,再分别在每个P基区中采用离子注入和推阱工艺形成N+区和P+区,且同时在形成N+区和P+区同时参杂形成若干个分压环;步骤四:三层结构栅的形成;步骤五:晶片的形成,本发明结构设计合理,提高VDMOS芯片的抗辐照性能和减弱单粒子烧毁效应。 | ||
| 搜索关键词: | 辐照 低电 阻抗 半导体缓冲层 多晶硅 基区 清洗 制造 抗辐照性能 三层结构 左右两侧 单粒子 分压环 缓冲层 晶片 刻蚀 离子 烧毁 | ||
【主权项】:
1.一种低电阻抗辐照VDMOS芯片的制造方法,其特征在于:该低电阻抗辐照VDMOS芯片的制造方法的具体步骤为:步骤一:材料的选择和清洗:选取N型硅外延片,并对N型硅外延片进行清洗,N型硅外延片为N+区;步骤二:缓冲层和N‑区的形成:先在N型硅外延片表面积淀一层半导体缓冲层,再在半导体缓冲层上积淀一层多晶硅,即N‑区;步骤三:重参杂N+区和P+的形成:在N‑区的顶部左右两侧刻蚀掉相应位置的多晶硅,形成P基区,再分别在每个P基区中采用离子注入和推阱工艺形成重参杂N+区和P+区,且同时在形成重参杂N+区和P+区同时参杂形成若干个分压环;步骤四:三层结构栅的形成:在完成步骤三后,在形成的器件顶部先用氮化栅氧化层工艺在600‑1000℃条件下制备N2O氮化栅氧化层,再用氢氧合成氧化法在600‑1000℃条件下制备的N2O氮化栅氧化层上制备氢氧合成栅氧化层,最后用氮化栅氧化层工艺在600‑1000条件下在氢氧合成栅氧化层上制备N2O氮化栅氧化层,三层结构栅备完成后,在800℃和N2气氛下退火30min;步骤五:晶片的形成:在硅片正面淀积金属形成源电极,在硅片背面淀积金属形成漏电极,完成芯片制造,并在芯片周围套接隔离保护。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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