[发明专利]一种基于时序路径验证FPGA接口时序的方法在审
| 申请号： | 201810045443.0 | 申请日： | 2018-01-17 |
| 公开（公告）号： | CN108267685A | 公开（公告）日： | 2018-07-10 |
| 发明（设计）人： | 石广;王硕 | 申请（专利权）人： | 郑州云海信息技术有限公司 |
| 主分类号： | G01R31/317 | 分类号： | G01R31/317 |
| 代理公司： | 济南舜源专利事务所有限公司 37205 | 代理人： | 张亮 |
| 地址： | 450000 河南省郑州市*** | 国省代码： | 河南;41 |
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| 摘要： | 本申请发明一种基于时序路径验证FPGA接口时序的方法，该方法将静态时序仿真和功能仿真分开分别进行验证，然后通过计算分析，最后得到接口时序验证结果。本发明所述的验证方法显著提高了FPGA接口仿真验证的效率及时序路径覆盖率，尤其对FPGA异步接口信号的验证效果明显。 | ||
| 搜索关键词： | 验证 时序 时序路径 仿真验证 功能仿真 计算分析 接口时序 静态时序 验证结果 异步接口 覆盖率 申请 | ||
【主权项】：
1.一种基于时序路径验证FPGA接口时序的方法，其特征在于，该方法具体包括：进行静态时序分析，得到接口时序路径延迟；进行功能仿真，得到接口信号的标准波形；根据前面两步的结果，计算FPGA接口信号极限情况下的建立时间和保持时间；FPGA接口信号极限情况下的建立时间和保持时间均满足时序要求时，验证通过，否则验证不通过。
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