[发明专利]一种吉比特连续可变速率的中频差分解调器有效

专利信息
申请号: 201810018014.4 申请日: 2018-01-09
公开(公告)号: CN108134754B 公开(公告)日: 2019-02-01
发明(设计)人: 朱代先;李国民;代新冠;马延军;张烨;汪正进;岳伟;林晨昕 申请(专利权)人: 西安科技大学
主分类号: H04L27/233 分类号: H04L27/233
代理公司: 陕西增瑞律师事务所 61219 代理人: 张瑞琪
地址: 710054 *** 国省代码: 陕西;61
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摘要: 发明公开了一种吉比特连续可变速率的中频差分解调器,包括中频信号输入端,中频信号输入端分别连接至第一放大器和第二放大器的输入端,第一放大器的输出端连接至混频器输入端,第二放大器的输出端通过可变时延传输线单元连接至混频器输入端,可变时延传输线单元通过伸长或缩短自身的长度,以改变信号的延迟;混频器的输出端依次通过滤波器、第三放大器连接至FPGA芯片,FPGA芯片用于对信号进行解调处理并输出至用户端;通过采用连续可变长度的同轴线使一路信号延时可连续调节,另外一路信号延时不变,从而使延时差的连续变化,大大拓宽了基于高速差分解调器的微波链路的应用范围。
搜索关键词: 放大器 连续可变 解调器 中频信号输入端 混频器输入端 传输线单元 可变时延 一路信号 输出端 中频差 延时 滤波器 输出端连接 改变信号 解调处理 连续调节 微波链路 混频器 输入端 同轴线 延时差 用户端 伸长 延迟 输出 应用
【主权项】:
1.一种吉比特连续可变速率的中频差分解调器,其特征在于,包括中频信号输入端,所述中频信号输入端分别连接至第一放大器和第二放大器的输入端,所述第一放大器的输出端连接至混频器输入端,所述第二放大器的输出端通过可变时延传输线单元连接至所述混频器输入端,所述可变时延传输线单元通过伸长或缩短自身的长度,以改变信号的延迟;所述混频器的输出端依次通过滤波器、第三放大器连接至FPGA芯片,所述FPGA芯片用于对信号进行解调处理并输出至用户端。
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