[发明专利]一种基于FPGA的PCIe与SRIO总线桥接系统有效
| 申请号： | 201710498016.3 | 申请日： | 2017-06-27 |
| 公开（公告）号： | CN107203484B | 公开（公告）日： | 2020-06-16 |
| 发明（设计）人： | 王啸林;张力 | 申请（专利权）人： | 北京计算机技术及应用研究所 |
| 主分类号： | G06F13/40 | 分类号： | G06F13/40 |
| 代理公司： | 中国兵器工业集团公司专利中心 11011 | 代理人： | 张然 |
| 地址： | 100854*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开了一种基于FPGA的PCIe与SRIO总线桥接系统，其中，PCIe IP核用于与上游设备数据交互，将上游设备发来的数据包转换为AXI4总线事务，将内部的AXI4总线事务转换为PCIe数据包，发送给上游设备；SRIO IP核，用于与对端SRIO设备通信；SRIO主模式DMA传输控制器模块用于主动发起数据请求；SRIO从模式DMA传输控制器模块用于响应对端设备的数据请求；Microblaze处理器用于执行系统初始化配置以及数据传输的调度工作；数据缓存模块用于PCIe与SRIO总线进行数据交互过程中，对中间过程数据进行暂存。 | ||
| 搜索关键词： | 一种 基于 fpga pcie srio 总线 系统 | ||
【主权项】：
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