[发明专利]一种验证平台和验证方法在审
| 申请号： | 201710389863.6 | 申请日： | 2017-05-27 |
| 公开（公告）号： | CN108959673A | 公开（公告）日： | 2018-12-07 |
| 发明（设计）人： | 韩彬;徐科 | 申请（专利权）人： | 深圳市中兴微电子技术有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 北京安信方达知识产权代理有限公司 11262 | 代理人： | 韩辉峰;李丹 |
| 地址： | 518055 广东省深*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种验证平台和验证方法，所述验证平台基于FPGA实现，包括通过片上总线互联的第一接口转换模块、平台配置模块、第一待测IP模块、第一内存模块和比对模块，其中，第一接口转换模块，用于接收外部计算机的测试数据并对其进行协议转换，将测试用例和第一计算结果输出至第一内存模块，将测试指令输出至第一待测IP模块；接收比对结果，并发送至外部计算机；第一待测IP模块，用于根据测试指令，获取测试用例并进行计算，生成第二计算结果，产生中断信号；比对模块，用于获取第一计算结果和第二计算结果进行比对。本发明利用FPGA高速并行阵列运算的特点，构建一套高速的PC与FPGA硬件通信的平台，能够极大地提高ASIC前期IP验证的效率。 | ||
| 搜索关键词： | 验证平台 接口转换模块 外部计算机 比对模块 测试指令 内存模块 验证 测试 比对结果 测试数据 高速并行 片上总线 平台配置 协议转换 硬件通信 中断信号 输出 比对 构建 运算 发送 互联 | ||
【主权项】：
1.一种验证平台，其特征在于，所述验证平台基于现场可编程门阵列FPGA实现，包括通过片上总线互联的第一接口转换模块、平台配置模块、第一待测IP模块、第一内存模块和比对模块，其中：所述第一接口转换模块，用于接收外部计算机的第一测试数据并对其进行协议转换，所述第一测试数据包括配置数据、测试用例、第一计算结果和测试指令；将配置数据输出至第一待测IP模块和平台配置模块，将测试用例和第一计算结果输出至第一内存模块，将测试指令输出至第一待测IP模块；接收比对模块的比对结果，并输出至外部计算机；所述平台配置模块，用于根据接收的配置数据，对自身所属FPGA进行配置；所述第一待测IP模块，用于根据接收的配置数据，对第一待测IP模块自身进行配置；根据测试指令，从第一内存模块获取测试用例并进行计算，生成第二计算结果，将第二计算结果存储至第一内存模块，产生中断信号并输出至比对模块；所述比对模块，用于接收到中断信号，从第一内存模块中获取第一计算结果和第二计算结果并进行比对，将比对结果发送至第一接口转换模块；所述第一内存模块，用于存储测试用例、第一计算结果和第二计算结果。
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