[发明专利]时钟信号输入的差分相位调整有效
| 申请号： | 201710082285.1 | 申请日： | 2017-02-16 |
| 公开（公告）号： | CN107086867B | 公开（公告）日： | 2021-07-20 |
| 发明（设计）人： | M·克莱拉;G·恩格尔 | 申请（专利权）人： | 美国亚德诺半导体公司 |
| 主分类号： | H03M1/06 | 分类号： | H03M1/06 |
| 代理公司： | 中国贸促会专利商标事务所有限公司 11038 | 代理人： | 陈华成 |
| 地址： | 美国马*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明涉及时钟信号输入的差分相位调整。差分时钟相位失衡可以在数模换器的输出产生不良杂散内容，或在模数转换器输出的频谱交织不良信号，或更一般地，在交错电路架构，取决于上升和下降沿差分输入时钟触发数模转换或模数转换。差分相位调整方法测量相位不平衡，并校正用于产生时钟信号的差分输入时钟信号，其驱动数模转换器或模数转换器。这种方法可以减少或消除这种相位不平衡，从而减少由于相位不平衡或差分时钟偏差的不利影响。 | ||
| 搜索关键词： | 时钟 信号 输入 相位 调整 | ||
【主权项】：
一种用于差分时钟相位调整以降低在数据转换器电路的输出的图像杂散的方法，该方法包括：观察数据转换器电路的输出，其中所述数据转换器电路由具有互相之间理想的相位差的伪差分时钟信号驱动；基于所述观测输出，估算与理想相位差的偏差；和基于所述估计的偏差，对于耦合到差分时钟输入信号的相应信号路径的独立控制电路块，产生控制信号，其中所述差分时钟输入信号用于产生伪差分时钟信号以调整所述差分时钟输入信号的相位。
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