[发明专利]基于功率密度的时钟单元间距有效
| 申请号： | 201680052191.3 | 申请日： | 2016-07-01 |
| 公开（公告）号： | CN108027843B | 公开（公告）日： | 2019-12-13 |
| 发明（设计）人： | A·纳亚克;D·A·基德;P·I·彭泽什 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 31100 上海专利商标事务所有限公司 | 代理人： | 亓云;陈炜 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本文中公开了用于基于功率密度的时钟单元间距以及结果所得的集成电路(IC)的技术。在一个示例中，这些技术确定不同类型的时钟单元的功率使用密度，因为功率使用密度与热和IR降有关。随着每一类型的时钟单元的功率使用密度被确定，这些技术为每一类型的时钟单元指派禁布区，该禁布区并非所有类型的时钟单元都是固定的。这些区域反而基于与针对每一类型的时钟单元的估计的功率使用密度相对应的热和IR降。时钟单元随后被放置在IC的布局中。结果所得的IC具有被充分间隔开以降低热和IR降，同时具有极好的时序收敛和性能的时钟单元。 | ||
| 搜索关键词： | 基于 功率密度 时钟 单元 间距 | ||
【主权项】：
1.一种集成电路，包括：/n具有第一禁布区的多个第一类型的时钟单元，所述第一类型具有第一功率使用密度；/n具有第二禁布区的多个第二类型的时钟单元，所述第二类型具有第二功率使用密度，所述第一和所述第二功率使用密度是不同的，所述第一和第二功率使用密度中较高的一者具有比所述第一和第二功率使用密度中较低的一者更大的禁布区；以及/n所述多个第一类型的时钟单元和所述多个第二类型的时钟单元在所述集成电路上的布局，所述布局将所述多个第一类型的时钟单元与所述多个第二类型的时钟单元分开，以使得相应时钟单元的相应禁布区不重叠。/n
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