[发明专利]用于制造半导体本体的方法有效
| 申请号: | 201680011290.7 | 申请日: | 2016-02-10 |
| 公开(公告)号: | CN107408531B | 公开(公告)日: | 2021-02-05 |
| 发明(设计)人: | 弗朗茨·埃伯哈德 | 申请(专利权)人: | 欧司朗光电半导体有限公司 |
| 主分类号: | H01L21/74 | 分类号: | H01L21/74 |
| 代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 丁永凡;张春水 |
| 地址: | 德国雷*** | 国省代码: | 暂无信息 |
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| 摘要: | 一种用于制造半导体本体的方法。提出一种用于制造半导体本体(1)的方法,所述半导体本体具有凹部(10),所述凹部设有钝化层(8),所述方法具有如下步骤:在半导体本体(1)上施加结构化的第一掩模层(5)和未结构化的第二掩模层(6);在第二掩模层(6)中构成至少一个第二掩模开口(60),并且在半导体本体(1)中构成至少一个凹部(10),其中凹部(10)与第二掩模开口(60)从第一掩模开口(50)起观察形成侧凹部(13);将钝化层(8)以未结构化的方式施加在第一掩模层(6)上和施加在凹部(10)的底面(12)和侧面(11)上;将钝化层(8)从第二掩模层(6)和凹部(10)的底面(12)移除,其中钝化层(8)保留在凹部(10)的侧面(11)上。 | ||
| 搜索关键词: | 用于 制造 半导体 本体 方法 | ||
【主权项】:
一种用于制造半导体本体(1)的方法,所述半导体本体具有凹部(10),所述凹部设有钝化层(8),所述方法具有如下步骤:A)提供所述半导体本体(1),B)在所述半导体本体(1)上施加第一掩模层(5)和第二掩模层(6),其中将所述第二掩膜层(6)未结构化地施加在所述半导体本体(1)上,并且将所述第一掩模层(5)以结构化为具有至少一个第一掩模开口(50)的方式施加在所述第二掩模层(6)上,C)在所述第一掩模层(5)的所述至少一个掩模开口(50)的区域中,在所述第二掩模层(6)中构成至少一个第二掩模开口(60)并且在所述半导体本体(1)中构成至少一个凹部(10),其中所述凹部(10)具有侧面(11)和底面(12),并且所述凹部(10)与所述第二掩模开口(60)从所述第一掩模开口(50)起观察形成侧凹部(13);D)将钝化层(8)以未结构化的方式施加在所述第二掩模层(6)上和施加在所述至少一个凹部(10)的所述底面(12)和所述侧面(11)上;E)将所述钝化层(8)从所述第二掩模层(6)的背离所述半导体本体(1)的一侧和从所述至少一个凹部(10)的所述底面(12)移除,其中所述钝化层(8)至少部分地保留在所述至少一个凹部(10)的所述侧面(11)上。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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