[发明专利]用于在加载数据元素以供执行时考虑空间局部性的装置和方法有效
申请号: | 201580061760.6 | 申请日: | 2015-10-09 |
公开(公告)号: | CN107111554B | 公开(公告)日: | 2021-01-22 |
发明(设计)人: | R·萨桑卡;E·乌尔德-阿迈德-瓦尔 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F12/0811 | 分类号: | G06F12/0811;G06F12/0875 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 何焜 |
地址: | 美国加利*** | 国省代码: | 暂无信息 |
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摘要: | 在本发明的一个实施例中,处理器包括上级高速缓存和至少一个处理器核。至少一个处理器核包括一个或多个寄存器以及多个指令处理级:解码单元,用于解码指令,指令需要多个数据元素的输入,其中多个数据元素中的每一个的大小小于处理器的高速缓存行的大小;执行单元,用于将多个数据元素加载到处理器的一个或多个寄存器,而不将空间上邻近所述多个数据元素的数据元素或所述多个数据元素加载到上级高速缓存中。 | ||
搜索关键词: | 用于 加载 数据 元素 执行 考虑 空间 局部性 装置 方法 | ||
【主权项】:
一种加载数据元素的处理器,包括:上级高速缓存;以及至少一个处理器核,耦合到所述上级高速缓存,包括一个或多个寄存器以及多个指令处理级:解码器单元,用于解码指令,所述指令需要多个数据元素的输入,其中所述多个数据元素中的每一个的大小小于所述处理器的高速缓存行的大小,以及执行单元,用于将所述多个数据元素加载到所述一个或多个寄存器,而不将空间上邻近所述多个数据元素的数据元素或所述多个数据元素加载到所述上级高速缓存中。
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