[实用新型]基于FPGA的LVDS数字视频传输接口装置有效
| 申请号： | 201521074946.9 | 申请日： | 2015-12-22 |
| 公开（公告）号： | CN205378080U | 公开（公告）日： | 2016-07-06 |
| 发明（设计）人： | 周宽 | 申请（专利权）人： | 中国电子科技集团公司第十一研究所 |
| 主分类号： | H04N5/77 | 分类号： | H04N5/77 |
| 代理公司： | 工业和信息化部电子专利中心 11010 | 代理人： | 罗丹 |
| 地址： | 100015*** | 国省代码： | 北京;11 |
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| 摘要： | 本实用新型提出了一种基于FPGA的LVDS数字视频传输接口装置，包括发送接口装置和/或接收接口装置，该发送接口装置包括：第一数字视频预处理模块、第一LVDS视频发送模块和第一LVDS标准I/O模块。本实用新型采用了一种工程上更加简洁的方式解决了Camera Link标准的数字视频信号的发送接收问题。本实用新型使FPGA系统的数字视频传输满足图像数据实时、稳定、高速传输的要求，为视频的传输途径提供了很好的解决方案。 | ||
| 搜索关键词： | 基于 fpga lvds 数字视频 传输 接口 装置 | ||
【主权项】：
一种基于现场可编程门阵列FPGA的低电压差分信号LVDS数字视频发送接口装置，其特征在于，包括：第一数字视频预处理模块、第一LVDS视频发送模块和第一LVDS标准I/O模块，其中，所述第一数字视频预处理模块对并行视频数据信号进行延迟和线序匹配处理以得到符合Camera Link标准时序要求的并行数据信号，并将所述并行数据信号及相应的时钟信号发送给所述第一LVDS视频发送模块；所述第一LVDS视频发送模块对所述并行数据信号进行并串转换得到串行数据信号，并将所述时钟信号和所述串行数据信号发送给所述第一LVDS标准I/O模块；所述第一LVDS标准I/O模块连接LVDS差分线缆，用于将所述时钟信号和所述串行数据信号传输出去。
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