[发明专利]包括带电荷穿通阻止层以降低穿通的CMOS器件及其制造方法有效

专利信息
申请号: 201510745228.8 申请日: 2015-11-05
公开(公告)号: CN105244353B 公开(公告)日: 2018-05-25
发明(设计)人: 朱慧珑;魏星 申请(专利权)人: 中国科学院微电子研究所
主分类号: H01L27/118 分类号: H01L27/118;H01L27/02;H01L21/8238
代理公司: 中科专利商标代理有限责任公司 11021 代理人: 倪斌
地址: 100029 *** 国省代码: 北京;11
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摘要: 公开了包括带电荷穿通阻止层以降低穿通的CMOS器件及其制造方法。根据实施例,一种CMOS器件包括n型器件和p型器件,其中,n型器件和p型器件各自均可以包括:在衬底上形成的鳍状结构;在衬底上形成的隔离层,其中鳍状结构在隔离层上方的部分充当该n型器件或p型器件的鳍;在鳍状结构位于鳍下方的部分的侧壁上形成的带电荷的穿通阻止层;以及在隔离层上形成的与鳍相交的栅堆叠,其中,对于n型器件,穿通阻止层带净负电荷;对于p型器件,穿通阻止层带净正电荷。
搜索关键词: 穿通 阻止层 鳍状结构 电荷 隔离层 衬底 净负电荷 净正电荷 栅堆叠 侧壁 相交 制造
【主权项】:
1.一种互补金属氧化物半导体CMOS器件,包括n型器件和p型器件,其中,n型器件和p型器件各自均包括:在衬底上形成的鳍状结构;在衬底上形成的隔离层,其中鳍状结构在隔离层上方的部分充当该n型器件或p型器件的鳍;在鳍状结构位于鳍下方的部分的侧壁上形成的带电荷的穿通阻止层;以及在隔离层上形成的与鳍相交的栅堆叠,其中,对于n型器件,穿通阻止层带净负电荷;对于p型器件,穿通阻止层带净正电荷。
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