[发明专利]用于非易失性存储器的互补解码有效
| 申请号： | 201380047703.3 | 申请日： | 2013-08-23 |
| 公开（公告）号： | CN104620321B | 公开（公告）日： | 2017-08-08 |
| 发明（设计）人： | 尼古拉斯·亨德里克森 | 申请（专利权）人： | 美光科技公司 |
| 主分类号： | G11C16/06 | 分类号： | G11C16/06;G11C16/08 |
| 代理公司： | 北京律盟知识产权代理有限责任公司11287 | 代理人： | 路勇 |
| 地址： | 美国爱*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明涉及为存储器装置提供解码的设备及使用此设备操作存储器装置的方法。所述设备包含具有耦合到第一输入节点的控制栅极的第一晶体管，其中当所述第一晶体管经配置为低阻抗状态时，所述第一晶体管将存储器阵列的一部分耦合到感测电路。所述设备进一步包含具有耦合到组合所述第一输入节点的信号与第二输入节点的信号的逻辑门的控制栅极的第二晶体管，其中当所述第二晶体管经配置为低阻抗状态时，所述第二晶体管将所述存储器阵列的一部分耦合到编程电路。所述第一晶体管及所述第二晶体管包括不同类型的晶体管。 | ||
| 搜索关键词： | 用于 非易失性存储器 互补 解码 | ||
【主权项】：
一种存储器设备，其包括：第一晶体管，其具有耦合到第一输入节点的控制栅极，其中当所述第一晶体管经配置为低阻抗状态时，所述第一晶体管将存储器阵列的一部分耦合到感测电路；以及第二晶体管，其具有耦合到组合所述第一输入节点的信号与第二输入节点的信号的逻辑门的控制栅极，其中当所述第二晶体管经配置为低阻抗状态时，所述第二晶体管将所述存储器阵列的一部分耦合到编程电路；其中所述第一晶体管及所述第二晶体管包括不同类型的晶体管；且其中所述逻辑门经配置以使得：当所述第一晶体管经配置为处于高阻抗状态时，所述第二晶体管经配置为处于高阻抗状态，当所述第一晶体管经配置为处于低阻抗状态且所述第二输入节点的所述信号具有第一逻辑电平时，所述第二晶体管经配置为处于高阻抗状态，且当所述第一晶体管经配置为处于低阻抗状态且所述第二输入节点的所述信号具有不同于所述第一逻辑电平的第二逻辑电平时，所述第二晶体管经配置为处于低阻抗状态。
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