[发明专利]用于测试逻辑模块中的地址总线的方法有效
| 申请号： | 200880111525.5 | 申请日： | 2008-09-10 |
| 公开（公告）号： | CN101821718A | 公开（公告）日： | 2010-09-01 |
| 发明（设计）人： | T·施奈德;P·沃思;O·普菲特泽 | 申请（专利权）人： | 罗伯特.博世有限公司 |
| 主分类号： | G06F11/267 | 分类号： | G06F11/267 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 宣力伟 |
| 地址： | 德国斯*** | 国省代码： | 德国;DE |
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| 摘要： | 本发明描述了一种用于测试逻辑模块(10)中的地址总线(14)的方法、逻辑模块(10)、计算机程序以及计算机程序产品。在所提出的方法上提出，在逻辑模块(10)中设有至少一个数据寄存器，被地址译码器(18)识别的地址被写入所述数据寄存器中。 | ||
| 搜索关键词： | 用于 测试 逻辑 模块 中的 地址 总线 方法 | ||
【主权项】：
用于测试逻辑模块(10)中的地址总线(14)的方法，其中在所述逻辑模块(10)中设有至少一个数据寄存器(20)，至少一个被地址译码器(18)在访问时识别的地址被写入所述数据寄存器(20)中，可以读取所述地址用于检查所述地址总线(14)的功能性。
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