[发明专利]分栅闪存的浮栅制造方法无效
申请号: | 200710094512.9 | 申请日: | 2007-12-14 |
公开(公告)号: | CN101459065A | 公开(公告)日: | 2009-06-17 |
发明(设计)人: | 贾晓宇;金勤海 | 申请(专利权)人: | 上海华虹NEC电子有限公司 |
主分类号: | H01L21/28 | 分类号: | H01L21/28;H01L21/336 |
代理公司: | 上海浦一知识产权代理有限公司 | 代理人: | 周 赤 |
地址: | 201206上*** | 国省代码: | 上海;31 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 本发明公开了一种分栅闪存的浮栅制造方法,首先以光刻胶作为为屏蔽掩模,并采用各向同性干法刻蚀形成浮栅的碗型凹槽;然后,沉积二氧化硅层,并利用干法回蚀技术形成半圆形氧化层;最后,利用自对准干法刻蚀,把氧化区以外的多晶硅刻蚀掉,从而得到尖锐的浮栅周边,从而确保了该最终形成的浮栅的形状不会受分栅闪存制造过程中其他操作步骤的影响,而且减少了本发明所述分栅闪存在闪存阵列中的片内断差,提高了生产效率高,使得工艺易于对浮栅的尖端优化且波动较小,而且上述方法实现起来较为简单,从一定程度上降低了制造成本。本发明所述方法还保证了在闪存实施擦除动作时,可减少擦除失效,降低擦除电压,使闪存单元更为易于控制。 | ||
搜索关键词: | 闪存 制造 方法 | ||
【主权项】:
1、一种分栅闪存的浮栅制造方法,其特征在于,包括:(1)在衬底(201)表面热氧化一层栅氧化层(202),随后在所述栅氧化层(202)上沉积一层多晶硅(203),然后涂上光刻胶(204);(2)借助光刻胶(204)作为掩模,对所述多晶硅203进行各向同性的干法刻蚀,在所述多晶硅(203)上形成浮栅的碗形凹槽;(3)对所述多晶硅(203)进行掺杂;(4)在掺杂后的多晶硅(203)上淀积一层二氧化硅(205);(5)对所述二氧化硅(205)进行干法回蚀,去除位于所述碗形凹槽外部的二氧化硅(205);(6)利用自对准干法刻蚀,去掉未被所述二氧化硅(205)覆盖的多晶硅(203)。
下载完整专利技术内容需要扣除积分,VIP会员可以免费下载。
该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于上海华虹NEC电子有限公司,未经上海华虹NEC电子有限公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
本文链接:http://www.vipzhuanli.com/patent/200710094512.9/,转载请声明来源钻瓜专利网。
- 上一篇:扩充卡的固定结构
- 下一篇:自动电压控制电路与相关方法
- 同类专利
- 专利分类
H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造