[实用新型]基于数控振荡器的数字锁相环电路无效

专利信息
申请号: 01258019.8 申请日: 2001-11-12
公开(公告)号: CN2520068Y 公开(公告)日: 2002-11-06
发明(设计)人: 刘永才 申请(专利权)人: 深圳市中兴集成电路设计有限责任公司
主分类号: H03L7/099 分类号: H03L7/099;H03L7/10
代理公司: 暂无信息 代理人: 暂无信息
地址: 518058 广东省深圳*** 国省代码: 广东;44
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摘要: 一种基于数控振荡器的数字锁相环电路,包括鉴相器、低通滤波器、数控振荡器、分频器,数控振荡器的输出经分频器分频后,形成反馈信号,反馈信号与参考信号在鉴相器里进行相位比较,其输出经低通滤波器的滤波作用后形成误差信号,该误差信号输入数控振荡器;所述数控振荡器包括加法器、输入寄存器、累加寄存器、在加法器和累加寄存器之间起保持作用的选择器、选择器辅助电路;加法器的输出端与选择器的输入端相连接,选择器的输出端与累加寄存器的输入端相连接,选择器的选择端接收来自选择器辅助电路的信号。本实用新型减少了数字锁相环电路相位锁定所需要的时间,使数字锁相环电路快速锁定。
搜索关键词: 基于 数控 振荡器 数字 锁相环 电路
【主权项】:
1、一种基于数控振荡器的数字锁相环电路,包括鉴相器、低通滤波器、数控振荡器、分频器,数控振荡器的输出经分频器分频后,形成反馈信号,反馈信号与参考信号在鉴相器里进行相位比较,其输出经低通滤波器的滤波作用后形成误差信号,该误差信号输入数控振荡器,其特征在于:所述数控振荡器包括输入寄存器、加法器、累加寄存器、在加法器和累加寄存器之间的选择器、选择器辅助电路;加法器的输出端与选择器的输入端相连接,选择器的输出端与累加寄存器的输入端相连接,选择器的选择端接收来自选择器辅助电路的信号,输入加法器的输出端、累加寄存器的输出端与加法器的输入端相连。
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