[发明专利]数据处理器和电子设备在审
申请号: | 202211670314.3 | 申请日: | 2022-12-23 |
公开(公告)号: | CN116009811A | 公开(公告)日: | 2023-04-25 |
发明(设计)人: | 孙浩威;孙福海 | 申请(专利权)人: | 北京奕斯伟计算技术股份有限公司 |
主分类号: | G06F7/52 | 分类号: | G06F7/52;G06F7/487 |
代理公司: | 中科专利商标代理有限责任公司 11021 | 代理人: | 杨静 |
地址: | 101111 北京市大兴区北京经*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 数据 处理器 电子设备 | ||
1.一种数据处理器,包括:
数据预处理电路,包括输入端和输出端;所述数据预处理电路配置为对经由所述输入端接收的待处理数据进行预处理,得到第一运算结果,其中,所述待处理数据包括标识符,以及经由所述输出端输出所述第一运算结果;
确定电路,与所述数据预处理电路电连接,配置为根据所述待处理数据的标识符和在后处理周期的待处理数据的标识符,确定当前处理周期的待处理数据与所述在后处理周期的待处理数据是否为累加数据,得到确定结果;其中,所述在后处理周期为所述当前处理周期的下一处理周期;
数据归一化电路,与所述确定电路电连接,配置为将所述第一运算结果进行归一化处理;以及根据所述确定结果,将归一化后的第一运算结果输出至所述数据预处理电路;
数据运算电路,与所述数据归一化电路电连接,配置为对所述归一化后的第一运算结果进行处理,得到针对所述当前处理周期的第二运算结果。
2.根据权利要求1所述的处理器,其中,所述数据归一化电路包括:
数据归一化子电路,与所述确定电路电连接,配置为将所述第一运算结果进行归一化处理,得到归一化后的第一运算结果;
第一寄存器,与所述数据归一化子电路电连接,配置为将所述归一化后的第一运算结果进行延时处理,得到延时后的第一运算结果;以及根据所述确定结果,将延时后的第一运算结果输出至所述数据预处理电路;其中,所述延时后的第一运算结果用于预处理所述在后处理周期的待处理数据,以完成对所述在后处理周期的待处理数据的处理。
3.根据权利要求1所述的处理器,其中,所述数据运算电路包括:
舍入子电路,配置为对所述归一化后的第一运算结果进行舍入处理,得到舍入后的第一运算结果;
溢出检查子电路,配置为对所述舍入后的第一运算结果进行溢出检查,得到溢出检查结果;
后舍入子电路,配置为根据所述溢出检查结果,对所述舍入后的第一运算结果进行后舍入处理,得到针对所述当前处理周期的第二运算结果。
4.根据权利要求1所述的处理器,其中,所述数据预处理电路包括:
移位对阶子电路,配置为对所述待处理数据进行移位对阶处理,得到第一中间数据;
第一运算子电路,配置为对所述第一中间数据进行运算处理,得到所述第一运算结果。
5.根据权利要求4所述的处理器,其中,所述待处理数据包括第一处理数据和第二处理数据,所述第一处理数据和所述第二处理数据均包括指数位和尾数;其中,所述移位对阶子电路还配置为:
根据所述第一处理数据的指数位和所述第一处理数据的指数位,得到指数位差值;
根据所述指数位差值,将所述第一处理数据和所述第二处理数据进行逻辑移位,以使所述第一处理数据的指数位和所述第二处理数的指数位对齐,得到所述第一中间数据。
6.根据权利要求5所述的处理器,其中,所述第一运算子电路还配置为:
将所述第一处理数据的尾数和第二处理数据的尾数进行运算和进位修正处理,得到所述第一运算结果;其中,所述第一运算结果包括尾数和、较大的指数位、前导1和截位;
所述尾数和为所述第一处理数据的尾数和第二处理数据的尾数之和;
所述较大的指数位为所述第一处理数据的指数位和所述第二处理数据的指数位中较大的指数位;
所述前导1根据所述尾数和得到,所述前导1用于指示冗余的符号位;
所述截位为所述第一处理数据的指数位和所述第二处理数据的指数位中指数位较小的处理数据进行移位对阶后截掉的尾数位。
7.根据权利要求6所述的处理器,其中,所述数据归一化子电路配置为:
根据所述前导1,对所述尾数和和所述截位进行拼接移位处理,得到归一化后的第一运算结果。
8.根据权利要求1所述的处理器,其中,还包括:
第二寄存器,与所述数据运算电路电连接,配置为存储来自所述数据运算电路的所述第二运算结果。
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