[发明专利]一种多相位时钟生成电路和时钟调相方法在审
| 申请号: | 202210089068.6 | 申请日: | 2022-01-25 |
| 公开(公告)号: | CN114567307A | 公开(公告)日: | 2022-05-31 |
| 发明(设计)人: | 吴雪莹;管武;邱昕;郑旭强 | 申请(专利权)人: | 中国科学院微电子研究所 |
| 主分类号: | H03K5/15 | 分类号: | H03K5/15 |
| 代理公司: | 北京辰权知识产权代理有限公司 11619 | 代理人: | 刘广达 |
| 地址: | 100029 *** | 国省代码: | 北京;11 |
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| 摘要: | |||
| 搜索关键词: | 一种 多相 时钟 生成 电路 调相 方法 | ||
本发明提供了一种多相位时钟生成电路和时钟调相方法,所述多相位时钟生成电路包括:四相信号生成模块,对输入信号进行T/4,T/2,3T/4的延时,得到具有0°,90°,180°,270°相移的四相信号,并输出给数字移相模块;控制码生成模块,设定控制码信号,并输出给数字移相模块;数字移相模块,接收所述四相信号和控制码信号,以使用所述控制码信号调整所述四相信号。本发明设计高速时钟信号相位调制装置,实现3.5Gsps以上信号的比较,解决了高速时钟信号的调相问题。
技术领域
本发明涉及信息处理领域,具体涉及一种多相位时钟生成电路和时钟调相方法。
背景技术
现有的时钟调相电路主要包括相位调整模块和控制信号模块。相位调整模块用于根据控制信号对输入信号进行相位调整,并输出多相时钟信号。为获得N个相位不同的时钟信号,一般采用N组控制信号调整相位移动。控制信号一般通过控制由DAC电路实现的尾电流源的比例来实现时钟信号相位调整。
时钟调相技术在芯片面积、功耗和工艺易移植方面有非常大的优势,因此得到广泛应用。但是,时钟调相技术也面临一些挑战,这种结构相位调整平滑,锁定速度快,但会随着设计精度降低,当时钟调相模块包括N个DAC电路时,此时钟调相电路所实现的调整相位的微分非线性(DNL)和积分非线性(INL)两个关键性能指标会因为N的不同而有所改变,从而可能导致时钟调相模块的精度的变化。
发明内容
本发明所要解决的技术问题是,克服现有技术的不足,提高时钟相位微分非线性和积分非线性,得到多相位调整,提出一种时钟调相方法、多相位时钟生成电路。
为了解决上述问题,本发明提供一种时钟调相方法、多相位时钟生成电路,包括:
四相信号生成模块,对输入信号进行T/4,T/2,3T/4的延时,得到具有0°,90°,180°,270°相移的四相信号,并输出给数字移相模块;
控制码生成模块,设定控制码信号,并输出给数字移相模块;
数字移相模块,接收所述四相信号和控制码信号,以使用所述控制码信号调整所述四相信号。
进一步地,所述四相信号生成模块通过代码生成方式实现。
进一步地,所述控制码生成模块使用温度计码的编码方式来实现控制码信号的设定。
进一步地,所述控制码生成模块中,相邻的控制信号发生变动时只能依次改变一位数值,每个单个最小二乘步长是通过控制信号仅改变一个电流控制元件的状态来实现或者翻转极性开关中的一个来实现。
进一步地,所述数字移相模块由电阻合成模块、双路差分放大模块、多输出恒流源模块组成,所述双路差分放大模块包括7个第一差分放大模块和9个第二差分放大模块,所述多输出恒流源模块包括两个七输出恒流源模块和一个九输出恒流源模块,其中,每个第一差分放大模块连接并由七输出恒流源模块供电,每个第二差分放大模块连接并由九输出恒流源模块供电。
进一步地,所述第一差分放大模块,包括14个MOSFET晶体管,分为三级,第一级包括八个晶体管,两两为一组组成电流镜偏置电路,每组中的两个晶体管的漏极各自连接电阻合成模块两个输出端中的一个,每组中的两个晶体管的源极之间连接并连接一个第二级晶体管的漏极;第二级晶体管为四个,分为两组,每组两个晶体管,每个组内两个晶体管的源极之间连接并连接一个第三级晶体管的漏极,并且每组第二级晶体管的其中一个晶体管的栅极连接一个反相器;第三级晶体管为两个,且每个第三级晶体管的漏极各自连接一个七输出恒流源模块。
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