[实用新型]一种基于FPGA的时隙交换装置有效
| 申请号： | 202121794921.1 | 申请日： | 2021-08-03 |
| 公开（公告）号： | CN216527167U | 公开（公告）日： | 2022-05-13 |
| 发明（设计）人： | 白清顺 | 申请（专利权）人： | 上海新殿光电子科技有限公司 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78 |
| 代理公司： | 上海宏京知识产权代理事务所(普通合伙) 31297 | 代理人： | 邓文武 |
| 地址： | 201400 上海*** | 国省代码： | 上海;31 |
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| 摘要： | |||
| 搜索关键词： | 一种 基于 fpga 交换 装置 | ||
1.一种基于FPGA的时隙交换装置，其特征在于：包括连接于PCM总线输入端的信号接收处理单元、时隙存储模块、连接于PCM总线输出端的信号发送处理单元和连接于外部微处理器的微处理器接口模块，所述时隙存储模块分别连接于所述信号接收处理单元、信号发送处理单元和微处理器接口模块；
所述信号接收处理单元包括信号接收模块、接收时隙缓存器和时隙存储控制模块，所述接收时隙缓存器分别连接于所述信号接收模块和时隙存储控制模块，所述信号接收模块连接于所述时隙存储控制模块；所述接收时隙缓存器包括用于乒乓操作的第一接收时隙缓存器和第二接收时隙缓存器；
所述信号发送处理单元包括信号发送模块、发送时隙缓存器、时隙交换控制模块和接续控制字存储器，所述发送时隙缓存器分别连接于所述信号发送模块和时隙交换控制模块，所述信号发送模块连接于所述时隙交换控制模块；所述发送时隙缓存器包括用于乒乓操作的第一发送时隙缓存器和第二发送时隙缓存器；所述接续控制字存储器分别连接于所述时隙交换控制模块和微处理器接口模块；
所述时隙存储模块包括第一时隙存储器和第二时隙存储器，所述第一时隙存储器与所述微处理器接口模块连接，所述第二时隙存储器与所述时隙交换控制模块连接。
2.根据权利要求1所述的一种基于FPGA的时隙交换装置，其特征在于：所述第一接收时隙缓存器和第二接收时隙缓存器是由FPGA逻辑单元构成的两个结构相同的缓存器。
3.根据权利要求1所述的一种基于FPGA的时隙交换装置，其特征在于：所述第一发送时隙缓存器和第二发送时隙缓存器是由FPGA逻辑单元构成的两个结构相同的缓存器。
4.根据权利要求1所述的一种基于FPGA的时隙交换装置，其特征在于：所述第一时隙存储器和第二时隙存储器是由FPGA内部集成RAM块构成的两个结构相同的双口RAM。
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