[实用新型]从设备有效
申请号: | 202120369928.2 | 申请日: | 2021-02-10 |
公开(公告)号: | CN215300600U | 公开(公告)日: | 2021-12-24 |
发明(设计)人: | M·库马尔;K·库马尔;N·德曼吉 | 申请(专利权)人: | 意法半导体(鲁塞)公司;意法半导体国际有限公司 |
主分类号: | H03K3/3565 | 分类号: | H03K3/3565;G06F13/42 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 王茂华;闫昊 |
地址: | 法国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 设备 | ||
1.一种从设备,所述从设备用于通过串行数据总线与主设备通信,其特征在于,所述从设备包括:
串行时钟输入焊盘,被配置为接收串行时钟;
数据采样电路系统,直接电连接到所述串行时钟输入焊盘,并且由所述串行时钟操作,以在所述串行时钟的每个边沿处对输出数据进行采样,并且将采样的所述输出数据输出到数字电路;以及
驱动电路系统,被配置为从所述数字电路接收采样的所述输出数据,并且经由数据输出焊盘将先前接收的采样的所述输出数据输出到所述主设备。
2.根据权利要求1所述的从设备,其特征在于,所述数据采样电路系统包括:
第一施密特触发器,被配置为响应于所述串行时钟的上升沿而选择性地生成第一时钟脉冲;
第一触发电路,由来自所述第一施密特触发器的所述第一时钟脉冲进行时钟控制并且被配置为接收所述输出数据;
第二施密特触发器,被配置为响应于所述串行时钟的下降沿而选择性地生成第二时钟脉冲;以及
第二触发电路,由来自所述第二施密特触发器的所述第二时钟脉冲进行时钟控制并且被配置为接收所述输出数据;
其中所述第一触发电路和所述第二触发电路的输出在节点处被耦合,以产生待输出到所述数字电路的采样的所述输出数据。
3.根据权利要求2所述的从设备,其特征在于,所述从设备还包括电平移位器,所述电平移位器被配置为将经由数据输入焊盘从所述主设备接收的输入数据从较低电压域移位到较高电压域;并且其中所述输出数据基于所述输入数据。
4.根据权利要求2所述的从设备,其特征在于,所述从设备还包括复用器,所述复用器被配置为接收来自所述第一施密特触发器和所述第二施密特触发器的输出的输入、并且向电平移位器提供输出,所述电平移位器将所述复用器的所述输出从较高电压域移位到较低电压域以产生要被路由到核心电路系统的时钟信号。
5.根据权利要求4所述的从设备,其特征在于,所述从设备还包括逻辑电路系统,所述逻辑电路系统被配置为从定义所述串行时钟的形式的控制信号生成用于所述第一施密特触发器、所述第二施密特触发器和所述复用器的控制信号。
6.根据权利要求2所述的从设备,其特征在于,所述从设备还包括逻辑电路系统,所述逻辑电路系统被配置为从定义所述串行时钟的形式的控制信号生成用于所述第一施密特触发器和所述第二施密特触发器的控制信号。
7.根据权利要求1所述的从设备,其特征在于,从所述数据采样电路系统接收采样的所述输出数据的所述数字电路包括复用器。
8.根据权利要求1所述的从设备,其特征在于,从所述串行时钟输入焊盘到所述数据采样电路系统的所述直接电连接通过核心电路系统被路由,并且回到输入输出环中,到达所述数据采样电路系统。
9.根据权利要求1所述的从设备,其特征在于,从所述串行时钟输入焊盘到所述数据采样电路系统的所述直接电连接仅通过输入输出环被路由。
10.根据权利要求1所述的从设备,其特征在于,所述从设备还包括:施密特触发器,被配置为接收所述串行时钟;以及电平移位器,被配置为将来自所述施密特触发器的输出从较高电压域移位到较低电压域以产生待路由到核心电路系统的时钟信号。
11.根据权利要求1所述的从设备,其特征在于,所述从设备根据串行外围接口SPI标准来操作。
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