[发明专利]半导体器件的制作方法、半导体器件、存储器及存储系统在审
| 申请号: | 202111651587.9 | 申请日: | 2021-12-30 | 
| 公开(公告)号: | CN114388440A | 公开(公告)日: | 2022-04-22 | 
| 发明(设计)人: | 颜丙杰 | 申请(专利权)人: | 长江存储科技有限责任公司 | 
| 主分类号: | H01L21/8234 | 分类号: | H01L21/8234;H01L27/088;H01L27/11529;H01L27/11573 | 
| 代理公司: | 深圳紫藤知识产权代理有限公司 44570 | 代理人: | 李莎 | 
| 地址: | 430205 湖北省武*** | 国省代码: | 湖北;42 | 
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| 摘要: | |||
| 搜索关键词: | 半导体器件 制作方法 存储器 存储系统 | ||
本发明实施例公开了一种半导体器件的制作方法、半导体器件、存储器及存储系统。所述方法包括:提供基底和多个栅极结构,所述基底包括多个间隔设置的有源区,所述多个栅极结构一一对应地位于多个有源区上;在相邻栅极结构之间形成具有空隙的间隔层。本发明实施例能够降低相邻栅极结构之间寄生电容的介电常数,提高半导体器件的电性能。
技术领域
本发明实施例涉及半导体技术领域,尤其涉及一种半导体器件的制作方法、半导体器件、存储器及存储系统。
背景技术
目前,半导体器件中晶体管与晶体管之间的间距变小,晶体管的栅极变高,使得相邻晶体管的栅极之间产生寄生电容,影响半导体器件的电性能。
发明内容
本发明实施例提供一种半导体器件的制作方法、半导体器件、存储器及存储系统,能够降低相邻栅极结构之间寄生电容的介电常数,提高半导体器件的电性能。
本发明实施例提供一种半导体器件的制作方法,包括:
提供基底和多个栅极结构,所述基底包括多个间隔设置的有源区,所述多个栅极结构一一对应地位于多个有源区上;
在相邻栅极结构之间形成具有空隙的间隔层。
进一步地,所述间隔层包括第一介质层和第二介质层;
所述在相邻栅极结构之间形成具有空隙的间隔层的步骤,包括:
在所述相邻栅极结构之间形成牺牲层,所述牺牲层的高度小于所述栅极结构的高度,所述牺牲层与所述第一介质层的材料不同;
在所述相邻栅极结构之间形成具有开口的第一介质层,且所述第一介质层位于所述牺牲层上;
通过所述开口去除所述牺牲层,以在所述相邻栅极结构之间形成与所述开口相连通的牺牲间隙;
通过所述开口在所述牺牲间隙中形成具有所述空隙的所述第二介质层。
进一步地,所述在所述相邻栅极结构之间形成牺牲层的步骤,包括:
在所述栅极结构上形成初始牺牲层,所述初始牺牲层还填充在所述相邻栅极结构之间;
对所述初始牺牲层进行刻蚀,以去除所述栅极结构背离所述基底一侧的部分初始牺牲层以及所述相邻栅极结构之间的部分初始牺牲层,得到所述牺牲层。
进一步地,所述在所述相邻栅极结构之间形成具有开口的第一介质层的步骤,包括:
在所述栅极结构上形成初始介质层,所述初始介质层覆盖所述牺牲层;
对所述初始介质层进行刻蚀,以去除所述栅极结构背离所述基底一侧的部分初始介质层,并在所述相邻栅极结构之间的初始介质层中形成所述开口,得到所述第一介质层。
进一步地,所述通过所述开口在所述牺牲间隙中形成具有所述空隙的所述第二介质层的步骤,包括:
在所述栅极结构上形成所述第二介质层,所述第二介质层覆盖所述第一介质层,并通过所述开口延伸至所述牺牲间隙中,使所述第二介质层在所述牺牲间隙中具有所述空隙。
进一步地,所述在相邻栅极结构之间形成具有空隙的间隔层的步骤之前,还包括:
对所述栅极结构的表面进行氧化,以在所述栅极结构的表面形成保护层。
进一步地,所述有源区为鳍式有源区,所述栅极结构位于所述鳍式有源区上并沿所述鳍式有源区的侧壁延伸。
本发明实施例还提供一种半导体器件,包括:
基底,包括多个间隔设置的有源区;
多个栅极结构,所述多个栅极结构一一对应地位于多个有源区上;
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





