[发明专利]半导体器件和制造半导体结构的方法在审
| 申请号: | 202110925459.2 | 申请日: | 2021-08-12 |
| 公开(公告)号: | CN113745166A | 公开(公告)日: | 2021-12-03 |
| 发明(设计)人: | 邱雅文;陈思颖;谭伦光 | 申请(专利权)人: | 台湾积体电路制造股份有限公司 |
| 主分类号: | H01L21/8238 | 分类号: | H01L21/8238;H01L27/092;H01L27/11 |
| 代理公司: | 北京德恒律治知识产权代理有限公司 11409 | 代理人: | 章社杲;李伟 |
| 地址: | 中国台*** | 国省代码: | 台湾;71 |
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| 摘要: | |||
| 搜索关键词: | 半导体器件 制造 半导体 结构 方法 | ||
1.一种用于制造半导体结构的方法,其包括:
形成从衬底垂直突出的鳍结构;
在所述鳍结构的表面上外延生长硅层;
执行第一快速热氮化(RTN)工艺,其中所述第一快速热氮化工艺将氮注入至外延生长的硅层中;
在已经执行所述第一快速热氮化工艺之后,在所述外延生长的硅层上方形成介电衬垫层;以及
在所述介电衬垫层上方形成介电隔离结构。
2.根据权利要求1所述的方法,其中:
形成所述鳍结构包括执行一个或多个蚀刻工艺来图案化所述鳍结构,其中在执行所述一个或多个蚀刻工艺之后,所述鳍结构具有第一表面粗糙度;以及
外延生长在所述鳍结构上的所述硅层具有小于所述第一表面粗糙度的第二表面粗糙度。
3.根据权利要求1所述的方法,其中,形成所述鳍结构包括形成包括硅锗材料的P型鳍结构。
4.根据权利要求3所述的方法,其中:
在所述鳍结构的所述硅锗材料上方形成一个或多个掩模层;以及
所述硅层外延生长在所述硅锗材料和所述一个或多个掩模层上。
5.根据权利要求4所述的方法,其中,在所述一个或多个掩模层上生长的所述硅层的第一部分比在所述硅锗材料上生长的所述硅层的第二部分厚。
6.根据权利要求1所述的方法,还包括:
在已经执行所述第一快速热氮化工艺之后,在所述硅层上形成氧化硅衬垫;以及
在所述氧化硅衬垫上方形成隔离结构。
7.根据权利要求1所述的方法,其中:
形成所述介电衬垫层还包括在所述外延生长的硅层上形成氧化硅衬垫层;以及
形成所述介电隔离结构包括直接在所述氧化硅衬垫层上形成浅沟槽隔离(STI)结构。
8.根据权利要求1所述的方法,其中:
形成所述介电衬垫层还包括在所述外延生长的硅层上形成氮化硅衬垫层;以及
形成所述介电隔离结构包括直接在所述氮化硅衬垫层上形成浅沟槽隔离(STI)结构。
9.一种用于制造半导体结构的方法,其包括:
将硅锗材料图案化成p型鳍结构,其中,所述图案化包括一个或多个蚀刻工艺;
在所述p型鳍结构上生长外延层;
将氮注入至所述外延层中;
在氮已经被注入至所述外延层中之后,在所述外延层上沉积氧化硅衬垫层;
将氮注入至所述氧化硅衬垫层中;以及
在氮已经被注入至所述氧化硅衬垫层中之后,在所述氧化硅衬垫层上方形成浅沟槽隔离(STI)结构。
10.一种半导体器件,包括:
鳍结构,从衬底垂直突出,其中,所述鳍结构包含硅锗(SiGe);
外延硅层,设置在所述鳍结构的侧壁上,其中,所述外延硅层包含氮;
一个或多个介电衬垫层,设置在所述外延硅层上;以及
介电隔离结构,设置在所述一个或多个介电衬垫层上方。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





