[发明专利]一种链式PECVD镀膜工艺稳定性的检测方法有效
| 申请号: | 202110714182.9 | 申请日: | 2021-06-25 |
| 公开(公告)号: | CN113539871B | 公开(公告)日: | 2022-07-01 |
| 发明(设计)人: | 王红芳;徐卓;赵学玲;潘明翠;陈志军;田思;李锋;史金超;李倩 | 申请(专利权)人: | 英利能源(中国)有限公司;英利能源发展有限公司 |
| 主分类号: | H01L21/66 | 分类号: | H01L21/66 |
| 代理公司: | 河北国维致远知识产权代理有限公司 13137 | 代理人: | 任青 |
| 地址: | 071051 河*** | 国省代码: | 河北;13 |
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| 摘要: | |||
| 搜索关键词: | 一种 链式 pecvd 镀膜 工艺 稳定性 检测 方法 | ||
1.一种链式PECVD镀膜工艺稳定性的检测方法,其特征在于,包括如下步骤:
采取相同镀膜工艺下不同时间点完成的镀膜硅片,烧结得半成品;
分别对所述半成品进行PL和隐性开路电压测试,或PL和饱和电流密度测试,或PL和隐性开路电压、饱和电流密度测试;
根据测试结果评估不同时间点所述链式PECVD镀膜工艺的稳定性;
其中,不同时间点的镀膜硅片前端各工序工艺保持一致;
不同时间点中至少一个时间点选自整个镀膜工艺周期的0-3/5时间段内;
各半成品进行PL、隐性开路电压、饱和电流密度测试的条件保持一致;
当各时间点得到的PL图像整体亮度均匀,整个镀膜工艺周期的0-3/5时间段内选取的时间点与其它时间点相比,PL图像亮度差大于10%,且烧结后硅片的边缘与中心的隐性开路电压值均相差10mV及以上;或各时间点得到的PL图像整体亮度均匀,整个镀膜工艺周期的0-3/5时间段内选取的时间点与其它时间点相比,PL图像亮度差大于10%,且烧结后硅片的边缘与中心的饱和电流密度值均相差5fA/cm2及以上时,判断链式PECVD镀膜工艺不稳定性;
当各时间点得到的PL图像整体亮度均匀,整个镀膜工艺周期的0-3/5时间段内选取的时间点与其它时间点相比,PL图像亮度差小于等于10%,且烧结后硅片的边缘与中心的隐性开路电压值均相差10mV以内;或各时间点得到的PL图像整体亮度均匀,整个镀膜工艺周期的0-3/5时间段内选取的时间点与其它时间点相比,PL图像亮度差小于等于10%,烧结后硅片的边缘与中心的饱和电流密度值均相差5fA/cm2以内时,判断链式PECVD镀膜工艺稳定;
当各时间点得到的PL图像整体亮度不均匀,整个镀膜工艺周期的0-3/5时间段内选取的时间点与其它时间点相比,PL图像亮度差大于10%,且只有烧结后硅片的边缘或中心的隐性开路电压值相差10mV及以上;或各时间点得到的PL图像整体亮度不均匀,整个镀膜工艺周期的0-3/5时间段内选取的时间点与其它时间点相比,PL图像亮度差大于10%,且只有烧结后硅片的边缘或中心的饱和电流密度值相差5fA/cm2及以上时,判断链式PECVD镀膜工艺稳定。
2.根据权利要求1所述的链式PECVD镀膜工艺稳定性的检测方法,其特征在于,不同时间点完成的镀膜硅片进行烧结的工艺保持一致。
3.根据权利要求1或2所述的链式PECVD镀膜工艺稳定性的检测方法,其特征在于,所述不同时间点选自整个镀膜工艺周期的0-3/5、3/5-4/5、4/5-1三个时间段内。
4.根据权利要求1或2所述的链式PECVD镀膜工艺稳定性的检测方法,其特征在于,所述镀膜为氮化硅镀膜和/或氧化铝膜。
5.根据权利要求1所述的链式PECVD镀膜工艺稳定性的检测方法,其特征在于,所述镀膜为双面镀膜或单面镀膜。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





