[发明专利]通过考虑单元间时序进行的单元感知缺陷特性化在审

专利信息
申请号: 202110473203.2 申请日: 2021-04-29
公开(公告)号: CN113569510A 公开(公告)日: 2021-10-29
发明(设计)人: R·郭;E·吉兹达尔斯基;X·蔡 申请(专利权)人: 新思科技有限公司
主分类号: G06F30/3308 分类号: G06F30/3308
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 章蕾
地址: 美国加利*** 国省代码: 暂无信息
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摘要:
搜索关键词: 通过 考虑 单元 时序 进行 感知 缺陷 特性
【权利要求书】:

1.一种方法,其包括:

使用多个输入、至少一个输出、及至少一个经建模缺陷对集成电路设计的单元进行建模;

基于所述多个输入中的至少一者的逻辑状态的组合与所述输出中的至少一者的状态所基于的强加在所述输入中的至少一者上的第一负载条件确定模型的所述输出中的所述至少一者的所述逻辑状态;

基于所述输入中的至少一者的所述逻辑状态与所述输出中的所述至少一者的所述状态所基于的强加在所述输入中的至少一者上的第二负载条件确定所述模型的所述输出中的所述至少一者的所述逻辑状态;及

当所述经建模缺陷中的至少一者针对输入逻辑状态的所述组合存在于所述模型中时,由处理器确定所述输出中的所述至少一者的所述逻辑状态在强加所述第一负载条件的情况下是否与在强加所述第二负载条件的情况下不同。

2.根据权利要求1所述的方法,其进一步包括:

基于逻辑状态的所述组合与强加在所述至少一个输出上的第三负载条件确定所述模型的所述输出中的所述至少一者的所述逻辑状态;

基于逻辑状态的所述组合与强加在所述至少一个输出上的第四负载条件确定所述模型的所述输出中的所述至少一者的所述逻辑状态;及

当所述经建模缺陷中的至少一者针对输入逻辑状态的所述组合存在于所述模型中时,确定所述输出中的所述至少一者的所述逻辑状态在强加所述第三负载条件的情况下是否与在强加所述第四负载条件的情况下不同。

3.根据权利要求1所述的方法,从所述至少一个输出的所述逻辑状态确定所述经建模缺陷是否是可检测的。

4.根据权利要求3所述的方法,从所述多个输入的所述逻辑状态、及所述至少输出的所述逻辑状态确定所述经建模缺陷是否是可检测的。

5.根据权利要求4所述的方法,其进一步包含:

使用所述多个输入及所述至少一个输出且在没有所述至少一个经建模缺陷的情况下对所述单元进行建模;

针对具有所述经建模缺陷的所述模型,基于所述多个输入中的至少一者的逻辑状态的所述预定组合确定所述模型的所述输出中的至少一者的所述逻辑状态;

针对不具有所述经建模缺陷的所述模型,基于所述多个输入中的至少一者的逻辑状态的所述预定组合确定所述模型的所述输出中的至少一者的所述逻辑状态;及

基于针对具有所述经建模缺陷的所述模型的所述至少一个输出的所述逻辑状态是否与针对不具有所述经建模缺陷的所述模型的所述至少一个输出的所述逻辑状态相同,确定所述经建模缺陷是否是可检测的。

6.根据权利要求1所述的方法,其进一步包括在缺陷检测表中指示所述经建模缺陷是否:

在所有输入负载条件下都可检测;

在一些输入负载条件下可检测,但在其它负载条件下不可检测;或

在所述输入负载条件中的任一者下都不可检测。

7.根据权利要求6所述的方法,其进一步包括在动态缺陷检测记录中指示所述经建模缺陷是否是可检测的,所述动态缺陷检测记录具有针对输入逻辑状态的每一唯一组合、输入负载条件及输出负载条件的缺陷条目。

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