[发明专利]掩膜版以及虚拟沟道孔的制作方法有效
申请号: | 202110219733.4 | 申请日: | 2021-02-26 |
公开(公告)号: | CN113009772B | 公开(公告)日: | 2023-07-25 |
发明(设计)人: | 郑亮;刘隆冬;黄海辉;郑安发 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | G03F1/00 | 分类号: | G03F1/00;G03F1/70;H10B41/30;H10B41/27;H10B43/30;H10B43/27 |
代理公司: | 北京派特恩知识产权代理有限公司 11270 | 代理人: | 高洁;张颖玲 |
地址: | 430074 湖北省武*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 掩膜版 以及 虚拟 沟道 制作方法 | ||
1.一种掩膜版,其特征在于,所述掩膜版应用于三维存储器中虚拟沟道孔的制作,包括:
掩膜图案阵列,包括:沿第一方向并列设置的多个第一子图案;其中,所述第一子图案位于所述掩膜图案阵列最外侧;
每个所述第一子图案包括:第一凹部;其中,所述第一凹部沿所述第一子图案边缘向所述第一子图案中心凹陷;所述第一凹部的开口朝向所述掩膜图案阵列的外侧;位于所述掩膜图案阵列同一侧的所述多个第一子图案的所述第一凹部的开口朝向相同。
2.根据权利要求1所述的掩膜版,其特征在于,所述掩膜图案阵列还包括:
沿第一方向并列设置的多个第二子图案;其中,所述第二子图案与所述第一子图案沿第二方向并列设置;所述第二方向垂直于所述第一方向;
所述第二子图案包括:第二凹部;其中,所述第二凹部的凹陷方向与相对靠近所述第二凹部的所述第一凹部凹陷方向相同,所述第二凹部的凹陷程度小于所述第一凹部的凹陷程度。
3.根据权利要求2所述的掩膜版,其特征在于,所述掩膜图案阵列还包括:
沿第一方向并列设置的多个第三子图案;其中,所述第三子图案,与所述第一子图案以及所述第二子图案沿第二方向并列设置;所述第二子图案位于所述第一子图案与所述第三子图案之间;
所述第一子图案和所述第二子图案之间的第一间距,不小于所述第二子图案和所述第三子图案之间的第二间距。
4.根据权利要求3所述的掩膜版,其特征在于,所述第一间距小于450nm。
5.根据权利要求3所述的掩膜版,其特征在于,所述第三子图案的形状包括:圆形或椭圆形。
6.根据权利要求3所述的掩膜版,其特征在于,所述掩膜版包括:
相对设置的第一表面及第二表面;其中,所述第一子图案、所述第二子图案和所述第三子图案,均包括贯穿所述第一表面及所述第二表面的空隙。
7.根据权利要求3至6任一项所述的掩膜版,其特征在于,
所述第一子图案、第二子图案和第三子图案透光;
所述掩膜版还包括不透光的基体部分。
8.根据权利要求1所述的掩膜版,其特征在于,所述第一凹部包括第一界面和第二界面;所述第一界面和所述第二界面之间的夹角小于180°。
9.根据权利要求8所述的掩膜版,其特征在于,所述第一界面和所述第二界面包括:凸面或平面。
10.根据权利要求1所述的掩膜版,其特征在于,所述第一子图案的形状包括:扇形。
11.一种虚拟沟道孔的制作方法,其特征在于,所述虚拟沟道孔应用如权利要求1至10任一项所述的掩膜版制作而成,所述方法包括:
提供半导体结构;其中,所述半导体结构包括衬底、位于所述衬底上的堆叠结构以及贯穿所述堆叠结构的沟道孔阵列或存储单元串阵列,所述沟道孔阵列用于形成所述存储单元串阵列;
对准所述掩膜图案阵列和所述衬底上用于形成虚拟沟道孔的区域,并使位于所述掩膜图案阵列同一侧的所述多个第一子图案的第一凹部朝向所述沟道孔阵列或所述存储单元串阵列;
通过所述掩膜图案阵列,在所述衬底上形成虚拟沟道孔。
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G03F 图纹面的照相制版工艺,例如,印刷工艺、半导体器件的加工工艺;其所用材料;其所用原版;其所用专用设备
G03F1-00 用于图纹面的照相制版的原版,例如掩膜,光掩膜;其所用空白掩膜或其所用薄膜;其专门适用于此的容器;其制备
G03F1-20 .用于通过带电粒子束(CPB)辐照成像的掩膜或空白掩膜,例如通过电子束;其制备
G03F1-22 .用于通过100nm或更短波长辐照成像的掩膜或空白掩膜,例如 X射线掩膜、深紫外
G03F1-26 .相移掩膜[PSM];PSM空白;其制备
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G03F1-38 .具有辅助特征的掩膜,例如用于校准或测试的特殊涂层或标记;其制备