[发明专利]64B/66B转换的serdes架构在审
| 申请号： | 202011504058.1 | 申请日： | 2020-12-18 |
| 公开（公告）号： | CN112543158A | 公开（公告）日： | 2021-03-23 |
| 发明（设计）人： | 李宁;宣学雷 | 申请（专利权）人： | 深圳市紫光同创电子有限公司 |
| 主分类号： | H04L25/49 | 分类号： | H04L25/49 |
| 代理公司： | 深圳国新南方知识产权代理有限公司 44374 | 代理人： | 胡志桐 |
| 地址： | 518000 广东省深圳市南山区粤海*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 64 66 转换 serdes 架构 | ||
1.一种64B/66B转换的serdes架构，其特征在于，包括XLGMII、PCS层和PMA层，配置所述PCS层和所述PMA层的接口位宽为66bit。
2.根据权利要求1所述的64B/66B转换的serdes架构，其特征在于，所述PCS层包括PCS发送装置，所述PCS发送装置包括编码模块和扰码模块，
所述编码模块，用于将所述XLGMII的接口数据编码为64B_66B块数据；
所述扰码模块，用于将所述64B_66B块数据进行扰码。
3.根据权利要求2所述的64B/66B转换的serdes架构，其特征在于，所述PMA层包括PMA发送装置。
4.根据权利要求3所述的64B/66B转换的serdes架构，其特征在于，所述PCS发送装置、PMA发送装置处于同一个时钟域。
5.根据权利要求1所述的64B/66B转换的serdes架构，其特征在于，所述PCS层包括PCS接收装置，所述PCS接收装置包括块同步模块、解扰码模块和解码模块，
所述块同步模块，用于根据块同步头信息对接收的64B_66B块数据进行同步界定；
所述解扰码模块，用于对所述64B_66B块数据进行解扰码；
所述解码模块，用于将所述解扰码后的64B_66B块数据进行解码并发送至所述XLGMII。
6.根据权利要求5所述的64B/66B转换的serdes架构，其特征在于，所述PMA层包括PMA接收装置。
7.根据权利要求6所述的64B/66B转换的serdes架构，其特征在于，所述PCS接收装置、PMA接收装置处于同一个时钟域。
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