[发明专利]基于无结型晶体管的表征方法在审
申请号: | 202011242826.0 | 申请日: | 2020-11-10 |
公开(公告)号: | CN112151403A | 公开(公告)日: | 2020-12-29 |
发明(设计)人: | 刘盛富;刘海彬;张均安;胡云斌;刘森 | 申请(专利权)人: | 微龛(广州)半导体有限公司 |
主分类号: | H01L21/66 | 分类号: | H01L21/66 |
代理公司: | 上海光华专利事务所(普通合伙) 31219 | 代理人: | 佟婷婷 |
地址: | 510663 广东省广州市高新技术*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 基于 无结型 晶体管 表征 方法 | ||
1.一种基于无结型晶体管的表征方法,其特征在于,所述表征方法包括步骤:
提供待测绝缘体上硅,所述待测绝缘体上硅依次包括衬底、中间埋氧层及顶层硅;
将第一探针和第二探针置于所述顶层硅上,所述第一探针与所述第二探针之间具有间距,所述第一探针构成第一端口,所述第二探针构成第二端口,所述衬底构成第三端口;
基于所述第三端口调整施加到所述衬底的偏置电压,以使所述待测绝缘体上硅工作在积累区,并获取积累区漏极电流,其中,获取所述积累区漏极电流的方式包括:ID积累= Ivol积累+ Iacc,Ivol积累为体区电流,Iacc为积累层电流;
基于所述第三端口调整施加到所述衬底的偏置电压,以使所述待测绝缘体上硅工作在部分耗尽区,并获取部分耗尽区漏极电流,其中,获取所述部分耗尽区漏极电流的方式包括:ID部分耗尽= Ivol部分耗尽,Ivol部分耗尽为体区电流,其中,在所述部分耗尽区工作时,设定体区迁移率为常数,所述体区电流Ivol部分耗尽为:Ivol部分耗尽=qfGμP,volNA,D(Tsi-WD)VD,其中,q为电子电荷,fG为几何因子,μP,vol为体区载流子迁移率,NA,D为受主(p型掺杂)或施主(n型掺杂)掺杂浓度,Tsi为顶层硅厚度,VD为漏极电压,WD为耗尽层宽度;以及
基于所述积累区漏极电流、所述部分耗尽区漏极电流以及施加到所述第一端口、所述第二端口及所述第三端口的电压表征所述待测绝缘体上硅的参数。
2. 根据权利要求1所述的基于无结型晶体管的表征方法,其特征在于,所述耗尽层宽度WD为:WD =(COX/(qNA,D))(VG-VFB),其中,COX为氧化硅单位面积电容,q为电子电荷,NA,D为受主(p型掺杂)或施主(n型掺杂)掺杂浓度,VG为栅极电压,VFB为平带电压。
3. 根据权利要求2所述的基于无结型晶体管的表征方法,其特征在于,基于所述耗尽层宽度WD和所述体区电流Ivol部分耗尽可得:Ivol部分耗尽=-fGμP,volCOX (VG-V0)VD(a),其中,V0=VFB+(qNA,D/ COX)Tsi(b),V0为伪MOS管体区刚刚全部耗尽的电压,基于公式(a)的斜率获得所述待测绝缘体上硅体区迁移率,基于公式(b)计算激活杂质浓度。
4.根据权利要求1所述的基于无结型晶体管的表征方法,其特征在于,在所述积累区工作时,所述体区电流Ivol积累为:Ivol积累=qfGμvolNA,DTsiVD(c),其中,q为电子电荷,fG为几何因子,μvol为体区载流子迁移率,NA,D为受主(p型掺杂)或施主(n型掺杂)掺杂浓度,Tsi为顶层硅厚度,VD为漏极电压。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造