[发明专利]完整性保护电路及其数据处理方法和原始数据校验装置在审

专利信息
申请号: 202010968478.9 申请日: 2020-09-15
公开(公告)号: CN112152607A 公开(公告)日: 2020-12-29
发明(设计)人: 刘君 申请(专利权)人: OPPO广东移动通信有限公司
主分类号: H03K19/21 分类号: H03K19/21;H03K19/01;H03K19/003;H04W12/10
代理公司: 深圳市智圈知识产权代理事务所(普通合伙) 44351 代理人: 吕静
地址: 523860 广东*** 国省代码: 广东;44
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摘要:
搜索关键词: 完整性 保护 电路 及其 数据处理 方法 原始数据 校验 装置
【说明书】:

本申请实施例提供一种完整性保护电路及其数据处理方法和原始数据校验装置,涉及信息安全技术领域,可提高时钟频率、满足吞吐量的需求,改善时钟与数据延时的问题。该完整性保护电路包括密钥输入电路、逻辑电路和数据输入电路。密钥输入电路向逻辑电路输入多个N位的密钥序列,密钥输入电路包括多个子输入电路;数据输入电路向逻辑电路输入原始数据。i为1~log2N之间的各个整数,i=1,第i异或电路的输入端与相邻两个子输入电路和第i级子数据输入电路连接,子输入电路向第i异或电路输入1位密钥,根据原始数据,输出2位密钥的异或结果;i≥2,根据原始数据,输出第n个第i‑1异或电路的异或结果与第n+2i‑1个第i‑1异或电路的异或结果的异或结果。

技术领域

本申请涉及信息安全技术领域,尤其涉及一种完整性保护电路及其数据处理方法和原始数据校验装置。

背景技术

在长期演进(Long Term Evolution,简称LTE)与NR(New Radio)网络安全架构协议中有许多标准化的加密算法与完整性保护算法。其中,加密算法包括128-EEA1、128-EEA2、以及128-EEA3;完整性保护算法包括128-EIA1、128-EIA2、以及128-EIA3。

以完整性保护算法128-EIA3为例,在计算消息完整性保护代码(MAC)的完整性保护电路中,包括多级组合电路,组合电路的级数往往决定了数字电路运算的最高时钟频率,同时也决定了运算电路的吞吐量。若组合电路的级数非常多,在某些极端设计情况下,计算MAC的完整性保护电路可能无法满足时钟频率和吞吐量的需求。

发明内容

本申请的目的包括,例如,提供了一种完整性保护电路及其数据处理方法和原始数据校验装置,可提高时钟频率、满足吞吐量的需求,还可改善时钟与数据延时的问题。

第一方面,提供一种完整性保护电路,包括密钥输入电路、逻辑电路和数据输入电路。密钥输入电路用于向逻辑电路输入多个N位的密钥序列,每相邻两个密钥序列构成一个密钥组,密钥输入电路包括多个子输入电路;数据输入电路包括与每个密钥组对应的log2N级子数据输入电路,用于向逻辑电路输入原始数据;其中,log2N≥2;逻辑电路包括与每个所述密钥组对应的log2N级子逻辑电路;对于log2N级子逻辑电路中的第i级子逻辑电路,i为1~log2N之间的各个整数;其中:当i=1时,第i级子逻辑电路包括2N-2个第i异或电路,每个第i异或电路的输入端与相邻两个子输入电路和第i级子数据输入电路连接,子输入电路向所述第i异或电路输入1位密钥,根据第i级子数据输入电路输入的原始数据,输出相邻两个子输入电路输入的2位密钥的异或结果,该异或结果作为第一异或结果;当i≥2时,第i级子逻辑电路包括2N-2i个第i异或电路,第n个第i异或电路的输入端与第i-1级子逻辑电路中的第n个和第n+2i-1个第i-1异或电路连接,根据第i级子数据输入电路输入的原始数据,输出第n个第i-1异或电路的异或结果与第n+2i-1个第i-1异或电路的异或结果的异或结果,该异或结果作为第i异或结果;n为1~2N-2i之间的整数。

第二方面,提供一种如第一方面所述的完整性保护电路的数据处理方法,包括:当i=1时,子输入电路向第i级子逻辑电路中的第i异或电路输入1位密钥,第i级子数据输入电路向第i异或电路输入原始数据。当i=1时,第i异或电路接收相邻两个子输入电路输入的密钥,并根据第i级子数据输入电路输入的原始数据,输出相邻两个子输入电路输入的2位密钥的异或结果。当i≥2时,第i级子逻辑电路的第n个第i异或电路接收第i-1级子逻辑电路的第n个第i-1异或电路的异或结果和第n+2i-1个第i-1异或电路的异或结果,并根据第i级子数据输入电路输入的原始数据,输出第n个第i-1异或电路的异或结果与第n+2i-1个第i-1异或电路的异或结果的异或结果,该异或结果作为第i异或结果。

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