[发明专利]基于RAM总线的Turbo译码存储方法及装置和译码器有效

专利信息
申请号: 202010750180.0 申请日: 2020-07-30
公开(公告)号: CN111865336B 公开(公告)日: 2021-11-02
发明(设计)人: 马文佳;刘莹;杨茂丰;马杨飞;马越 申请(专利权)人: 北京芯领航通科技有限公司
主分类号: H03M13/25 分类号: H03M13/25;H04L1/00
代理公司: 北京汇彩知识产权代理有限公司 11563 代理人: 王键
地址: 100120 北京市*** 国省代码: 北京;11
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摘要:
搜索关键词: 基于 ram 总线 turbo 译码 存储 方法 装置 译码器
【权利要求书】:

1.一种基于RAM总线的Turbo译码存储方法,其特征在于,包括以下步骤:

1)设置第一随机存取存储器ram1,接收总线数据;

2)设置第二随机存取存储器ram2;从总线上接收一组数据后,进行解复用,把信息位存储到第二随机存取存储器ram2中;

3)将解复用后的校验位存储到第一随机存取存储器ram1中,重复利用ram1;

所述校验位包括两种校验信息,第一编码器输出的校验信息是校验位A、校验位B,第二编码器输出的校验信息是校验位A’、校验位B’;所述ram1存储校验信息的方式是偶地址存储第一编码器输出的校验位A、校验位B,奇地址存储的是第二编码器输出的校验位A’、校验位B’;

4)将译码输出的译码结果也存储到第一随机存取存储器ram1中,再重复利用ram1。

2.根据权利要求1所述的基于RAM总线的Turbo译码存储方法,其特征在于,还包括设置第三随机存取存储器arm3,存储作为译码先验信息的外部信息。

3.根据权利要求2所述的基于RAM总线的Turbo译码存储方法,其特征在于,所述第三随机存取存储器arm3存储的外部信息,在第一次迭代译码时,令z1(m)=0,作为本次译码的先验信息ap1;第一译码器从第二随机存取存储器ram2读取信息位X、从第一随机存取存储器ram1读取校验位A、校验位B,用信息位X、校验位A,B、先验信息ap1进行译码得到对数似然比LLR1,把对数似然比LLR1减去先验信息ap1和信息位X,得到外部信息z2(m),存储到ram3中;

第二译码器经交织器从第三随机存取存储器arm3中读取外部信息z2(m),作为本次译码的先验信息ap2,并从第二随机存取存储器ram2经交织器读取信息位X’、从第一随机存取存储器ram1读取校验位A’、校验位B’,用信息位X’、校验位A’,B’、先验信息ap2进行译码得到似然值LLR2,似然值LLR2减去先验信息ap2和信息位X’,得到外部信息z1(m),原位存储到ram3并覆盖外部信息z2(m)。

4.根据权利要求3所述的基于RAM总线的Turbo译码存储方法,其特征在于,所述似然值LLR2经解交织器后,与门限值进行比较,得到硬判决结果,作为本次Turbo译码输出结果存储到ram1;所述ram1存储硬判决结果的方式是,从高地址向低地址存储。

5.一种采用如权利要求1至4之一所述的基于RAM总线的Turbo译码存储方法的存储装置,其特征在于,包括第一随机存取存储器ram1以及第二随机存取存储器ram2,所述第一随机存取存储器ram1与RAM总线连接,用于缓存接收的总线数据;还连接解复用模块,存储解复用后的校验位数据;所述第一随机存取存储器ram1的偶地址存储第一个编码器输出的校验位A、校验位B,奇地址存储第二个编码器输出的校验位A’、校验位B’;所述第二随机存取存储器ram2连接解复用模块,用于存储解复用后的信息位数据;所述第一随机存取存储器ram1还连接门限判决模块,用于存储译码输出的硬判决结果。

6.根据权利要求5所述的基于RAM总线的Turbo译码存储方法的存储装置,其特征在于,所述第一随机存取存储器ram1存储硬判决结果是从高地址向低地址存储。

7.根据权利要求6所述的基于RAM总线的Turbo译码存储方法的存储装置,其特征在于,还包括第三随机存取存储器ram3,用于存储作为译码先验信息的外部信息。

8.一种译码器,采用如权利要求5至7之一所述的基于RAM总线的Turbo译码存储方法的存储装置,其特征在于,还包括第一译码器、第二译码器,交织器、解交织器;所述第一译码器分别连接第一随机存取存储器ram1以及第二随机存取存储器ram2,通过解交织器连接第三随机存取存储器ram3;所述第二译码器连接第一随机存取存储器ram1,通过交织器连接第二随机存取存储器ram2,还通过交织器连接第三随机存取存储器ram3,第二译码器还通过解交织器和门限判决器连接第一随机存取存储器ram1。

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