[发明专利]一种针对二维码设备提高有效数据传输速率的方法在审
| 申请号: | 202010393954.9 | 申请日: | 2020-05-11 |
| 公开(公告)号: | CN113642345A | 公开(公告)日: | 2021-11-12 |
| 发明(设计)人: | 魏芳芳 | 申请(专利权)人: | 北京君正集成电路股份有限公司 |
| 主分类号: | G06K7/10 | 分类号: | G06K7/10;G06K7/14 |
| 代理公司: | 北京竹辰知识产权代理事务所(普通合伙) 11706 | 代理人: | 聂鹏 |
| 地址: | 100193 北京市海淀区西北旺*** | 国省代码: | 北京;11 |
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| 摘要: | |||
| 搜索关键词: | 一种 针对 二维码 设备 提高 有效 数据传输 速率 方法 | ||
1.一种针对二维码设备提高有效数据传输速率的方法,其特征在于,所述方法针对YUV4:2:2的传输方式,所述方法包括以下步骤:
S1,利用逻辑电路控制采样时钟进而控制采集行扫描信号HSYNC和列扫描信号VSYNC的变化,确定VSYNC和HSYNC的状态;
S2,利用传感器传输PCLK的二分频采样,根据MCU_PCLK的下降沿或上升沿采样只采集Y数据;
S3,只有HSYNC和VSYNC都有效时,DVP接口上的数据才为有效数据,处理器会在接收到全部数据后进行处理,提取有效的Y数据即灰度数据作为二维码的图像数据。
2.根据权利要求1所述的一种针对二维码设备提高有效数据传输速率的方法,其特征在于,所述步骤S1中通过逻辑电路控制进而控制时钟。
3.根据权利要求1所述的一种针对二维码设备提高有效数据传输速率的方法,其特征在于,所述步骤S1中所述的采样时钟是传输给处理器的时钟信号MCU_PCLK能够采集到VSYNC和HSYNC的变化。
4.根据权利要求1所述的一种针对二维码设备提高有效数据传输速率的方法,其特征在于,所述步骤S1进一步包括:
设置HSYNC高有效,VSYNC高有效:逻辑电路中使用异或门元器件,VSYNC和HSYNC为低时,控制时钟信号采集VSYNC和HSYNC为低状态,在VSYNC和HSYNC为高时,采集到VSYNC和HSYNC都为有效状态;或
设置HSYNC高有效,通过控制传感器设置VSYNC低有效,或者通过非逻辑器件进行取反,再和HSYNC通过一个或器件采集为有效状态;
控制PCLK的二分频MCU_PCLK的产生。
5.根据权利要求1所述的一种针对二维码设备提高有效数据传输速率的方法,其特征在于,所述步骤S2进一步包括:
S2.1,利用D触发器的逻辑真值表做二分频电路,一直拉高,将与D相连,即每个PCLK的上升沿到来一次MCU_PCLK的电平变化一次,那么为低时Q状态即MCU_PCLK为低电平,为高;则
S2.2,配置传感器输出格式UYVY或YUVY,根据真值表可知,在由低变高后,第一个PCLK上升沿采集信号时,MCU_PCLK由低变为高,当第二个PCLK上升沿采信号时,MCU_PCLK由高变为低,接着PCLK继续采集信号时,MCU_PCLK由低变为高,接着当PCLK再次继续采集信号时,MCU_PCLK又由高变为低;
S2.3,处理器端即可根据MCU_PCLK的下降沿或上升沿采样采集到Y数据。
6.根据权利要求5所述的一种针对二维码设备提高有效数据传输速率的方法,其特征在于,所述的S2.2进一步包括:
如果配置传感器输出格式为UYVY,那么根据真值表可知,在由低变高后,第一个PCLK上升沿采集Cb或Cr时,MCU_PCLK由低变高,当第二个PCLK上升沿采集Y时,MCU_PCLK由高变低,接着PCLK采集Cb或Cr时,MCU_PCLK由低变为高,当PCLK再次采集Y时,MCU_PCLK又变为低。
7.根据权利要求6所述的一种针对二维码设备提高有效数据传输速率的方法,其特征在于,所述的S2.3进一步包括:那么处理器端即根据MCU_PCLK的下降沿采样采集到Y数据。
8.根据权利要求5所述的一种针对二维码设备提高有效数据传输速率的方法,其特征在于,所述的S2.2进一步包括:
如果配置传感器输出格式为YUVY,那么根据真值表可知,在由低变高后,第一个PCLK上升沿采集Y时,MCU_PCLK由低变高,接着PCLK采集Cb或Cr时,MCU_PCLK由高变为低,当PCLK再次采集Y时,MCU_PCLK又变化为高。
9.根据权利要求8所述的一种针对二维码设备提高有效数据传输速率的方法,其特征在于,所述的S2.3进一步包括:处理器即根据MCU_PCLK的上升沿采样Y数据。
10.根据权利要求1所述的一种针对二维码设备提高有效数据传输速率的方法,其特征在于,所述步骤S3进一步包括:PCLK经过D触发器后输出的MCU_PCLK为二分频时钟只采集Y数据。
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