[发明专利]一种解速率匹配方法及装置有效

专利信息
申请号: 202010177437.8 申请日: 2020-03-13
公开(公告)号: CN113395133B 公开(公告)日: 2022-08-02
发明(设计)人: 王俊 申请(专利权)人: 大唐移动通信设备有限公司
主分类号: H04L1/00 分类号: H04L1/00
代理公司: 北京润泽恒知识产权代理有限公司 11319 代理人: 莎日娜
地址: 100191*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 速率 匹配 方法 装置
【权利要求书】:

1.一种解速率匹配方法,其特征在于,所述方法包括:

获取用户上行数据中每个码块的空比特个数,根据所述空比特个数以及预设的交织序列数据表,确定所述用户的码流序列;其中,所述码流序列包括:系统数据SYS序列、第一校验码P1序列以及第二校验码P2序列,其中,根据所述空比特个数以及预设的交织序列数据表,确定所述用户的系统数据SYS序列;将所述SYS序列加上所述空比特个数,得到所述第一校验码P1序列,以及将所述SYS序列中所述空比特个数的2倍,得到所述第二校验码P2序列;

根据所述空比特个数以及所述码流序列,构造所述用户的构造SYS序列、构造P1P2累加序列,并确定所述构造P1P2累加序列的数据标志位序列;

根据所述空比特个数、所述数据标志位序列以及所述用户的冗余版本RV参数,确定解速率匹配的起始位置序列;

根据所述起始位置序列,确实所述用户的列起始位置以及行索引位置,得到输出序列。

2.根据权利要求1所述的解速率匹配方法,其特征在于,所述将所述SYS序列加上所述空比特个数,得到所述第一校验码P1序列的步骤,包括:

将所述SYS序列中的数据加上所述空比特个数后,若所述SYS序列中的数据个数大于32,则对所述SYS序列与32进行取模操作,得到P1序列;

和/或

所述将所述SYS序列中所述空比特个数的2倍,得到所述第二校验码P2序列的步骤,包括:

将所述SYS序列中的数据加上所述空比特个数的2倍后,若所述SYS序列中的数据个数大于32,则对所述SYS序列与32进行取模操作,得到中间P2序列;

根据第一公式,对所述中间P2序列进行高低位交换操作,得到P2序列,所述第一公式为:

P2=P2_SEQ[17:32,9:16,5:8,3:4,2,1]

其中,P2为所述第二校验码P2序列,P2_SEQ为所述中间P2序列。

3.根据权利要求1所述的解速率匹配方法,其特征在于,所述根据所述空比特个数以及所述码流序列,构造所述用户的构造SYS序列、构造P1P2累加序列的步骤,包括:

根据所述空比特个数、所述SYS序列以及第二公式,得到构造SYS序列,所述第二公式为:

ACC_SYS=(R-1)*ones(1,N) ,R*ones(1,32-N)

其中,ACC_SYS为所述构造SYS序列;R=Ceil[ (K+4)/32] ,K为所述用户速率匹配后的样点个数;N为所述空比特个数;ones(x,y)代表了x*y的单位矩阵;

以及

根据所述空比特个数、所述构造SYS序列以及第三公式,得到构造P1P2累加序列,所述第三公式为:

ACC_P1P2=ACC_SYS[17:32,9:16,5:8,3:4,2,1];

其中,ACC_P1P2为所述构造P1P2累加序列,ACC_SYS为所述构造SYS序列。

4.根据权利要求1所述的解速率匹配方法,其特征在于,所述确定所述构造P1P2累加序列的数据标志位序列的步骤,包括:

根据所述空比特个数、所述构造P1P2累加序列以及预设的标志位表,得到构造P1P2累加序列的数据标志位序列。

5.根据权利要求1所述的解速率匹配方法,其特征在于,所述确定解速率匹配的起始位置序列的步骤,包括:

根据所述用户的冗余版本RV参数以及所述构造SYS序列或所述构造P1P2累加序列,确定解速率匹配的起始位置序列。

6.根据权利要求5所述的解速率匹配方法,其特征在于,所述根据所述起始位置序列,确定所述用户的列起始位置以及行索引位置,得到输出序列的步骤,包括:

根据所述起始位置序列、所述构造SYS序列以及所述构造P1P2累加序列,得到列起始位置序列;所述列起始位置序列中包括每列数据的列起始位置的列索引;

根据所述列起始位置序列以及所述数据标志位序列,确定行索引位置,得到输出序列。

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