[发明专利]蚀刻方法、等离子体处理装置和处理系统在审
申请号: | 202010045816.1 | 申请日: | 2020-01-16 |
公开(公告)号: | CN111508831A | 公开(公告)日: | 2020-08-07 |
发明(设计)人: | 西出大亮;久松亨;石川慎也 | 申请(专利权)人: | 东京毅力科创株式会社 |
主分类号: | H01L21/3065 | 分类号: | H01L21/3065;H01J37/32 |
代理公司: | 北京尚诚知识产权代理有限公司 11322 | 代理人: | 龙淳;徐飞跃 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 蚀刻 方法 等离子体 处理 装置 系统 | ||
本发明提供一种膜的蚀刻方法。一个实施方式的蚀刻方法包括在基片上形成含硅层的步骤。基片具有膜和掩模。含硅层由使用含有硅的前体气体的等离子体处理形成。含硅层包括硅、碳和氮。蚀刻方法还包括进行膜的等离子体蚀刻的步骤。从在基片上形成含硅层的步骤的开始时刻到进行膜的等离子体蚀刻的步骤的结束时刻的期间中,基片配置在减压了的环境下。由此,能够在掩模上形成与硅氧化层不同的层来对膜进行蚀刻。
技术领域
本发明例示的实施方式涉及蚀刻方法、等离子体处理装置和处理系统。
背景技术
在电子器件的制造中,为了将掩模的图案转印至基片的膜而进行等离子体蚀刻。在等离子体蚀刻执行前为了使掩模的开口宽幅变窄,有时在基片上形成硅氧化层。基片的膜中,利用等离子体蚀刻对硅氧化层有选择地进行蚀刻。这样的技术记载于专利文献1。
现有技术文献
专利文献
专利文献1:日本特开2016-76621号公报。
发明内容
发明要解决的技术问题
要求在掩模上形成与硅氧化层不同的层来对膜进行蚀刻。
用于解决问题的技术手段
在一个例示的实施方式中,提供一种对膜进行的蚀刻方法。蚀刻方法包括在基片上形成含硅层的步骤。基片具有膜和掩模。掩模设置在膜上并被图案化。含硅层通过使用了含硅的前体气体的等离子体处理而形成。含硅层包括硅、碳和氮。含硅层的材料与膜的材料不同。蚀刻方法还包括进行膜的等离子体蚀刻的步骤。从在基片上形成含硅层的步骤的开始时刻到进行膜的等离子体蚀刻的步骤的结束时刻为止的期间中,基片配置在被减压了的环境下。
发明效果
根据一个例示的实施方式,能够在掩模上形成与硅氧化层不同的层来对膜进行蚀刻。
附图说明
图1是一个例示的实施方式的蚀刻方法的流程图。
图2中,图2的(a)是掩模的形成前的一个状态下的一例的基片的局部放大截面图,图2的(b)是掩模的形成前的另一状态下的一例的基片的局部放大截面图,图2的(c)是一例的基片的局部放大截面图。
图3是概略表示能够在图1所示的蚀刻方法的执行中使用的一例的等离子体处理装置的图。
图4中,图4的(a)是方法MT的步骤ST1执行后的状态下的一例的基片的局部放大截面图,图4的(b)是进行了含硅层的回蚀后的状态下的一例的基片的局部放大截面图。
图5中,图5的(a)是方法MT的步骤ST2执行后的状态下的一例的基片的局部放大截面图,图5的(b)是掩模除去后的状态下的一例的基片的局部放大截面图。
图6是图1所示的蚀刻方法的步骤ST1的一例的时序图。
图7是概要表示能够在图1所示的蚀刻方法的执行中使用的一例的处理系统的图。
图8中,图8的(a)是处理前的样品的图像,图8的(b)是比较实验的步骤ST2应用后的样品的图像,图8的(c)是实验的步骤ST2应用后的样品的图像。
图9是表示另一实验中制作出的含硅层的X射线光电子分光法得到的Si-2p谱的图。
附图标记说明
1……等离子体处理装置,10……腔室,GS……气体供给部,62……第一高频电源,64……第二高频电源,MC……控制部,MT……方法,W……基片。
具体实施方式
以下说明各种例示的实施方式。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造