[发明专利]一种基于DSP的总线控制电路有效

专利信息
申请号: 201911421722.3 申请日: 2019-12-31
公开(公告)号: CN111209235B 公开(公告)日: 2023-03-21
发明(设计)人: 宋杰;夏杰;李凯;赵江涛;陈飞茹;任欢 申请(专利权)人: 西安翔腾微电子科技有限公司
主分类号: G06F13/38 分类号: G06F13/38;G06F13/10
代理公司: 西安嘉思特知识产权代理事务所(普通合伙) 61230 代理人: 王海栋
地址: 710065 陕西省西*** 国省代码: 陕西;61
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摘要:
搜索关键词: 一种 基于 dsp 总线 控制电路
【说明书】:

发明公开了一种基于DSP的总线控制电路,包括DSP模块、固化模块,所述固化模块、所述异步总线和所述PCI总线均连接至所述DSP模块,其中,FLASH模块,用于固化所述异步总线和所述PCI总线、所述异步总线和第一设备或者所述PCI总线和第二设备之间通信的预设内容;DSP模块,用于根据所述预设内容实现所述异步总线和所述PCI总线、所述异步总线和第一设备或者所述PCI总线和第二设备之间的通信。本发明的总线控制电路能够实现异步总线和PCI总线的直接通信,还能实现异步总线和其它设备的直接通信以及PCI总线和其它设备的直接通信,解决了目前异步总线和PCI总线不能直接通信的问题。

技术领域

本发明属于电子电路设计技术领域,具体涉及一种基于DSP的总线控制电路。

背景技术

异步总线没有统一的时钟而依靠各部件或设备内部定时操作,所有部件或设备是以信号握手的方式进行,即发送设备和接受设备互用请求(request)和确认(acknowledgement)信号来协调动作,总线操作时序不是固定的。因此,异步总线能兼容多种不同的设备,而且不必担心时钟变形或同步问题使得总线长度不受限制。

PCI(Peripheral Component Interconnect,外设部件互连标准)总线是一种兼容性最强、功能最全的计算机总线。其可同时支持多组外围设备,且不受制于处理器,为CPU(中央处理器,Central Processing Unit)及高速外围设备提供高性能、高吞吐量、低延迟的数据通路。PCI支持5V及3.3V的通信环境,以反射波作为通信基础。当入射信号从无终端方向反射回来之后,反射波经过结构性干扰与入射波合成一体,完成电压与电流的驱动任务,因此PCI又称“非终端式传输总线”。

目前,虽然存在多种类接口通信转换电路并被广泛应用于工业控制等领域,但是受到系统接口类型限制影响,无法实现不同种类接口直接通信,尤其是对于异步总线和PCI总线而言,无法实现异步总线和PCI总线的直接通信。

发明内容

为了解决现有技术中存在的上述问题,本发明提供了一种基于DSP的总线控制电路。本发明要解决的技术问题通过以下技术方案实现:

一种基于DSP的总线控制电路,包括DSP模块、固化模块,所述固化模块、所述异步总线和所述PCI总线均连接至所述DSP模块,其中,

FLASH模块,用于固化所述异步总线和所述PCI总线、所述异步总线和第一设备或者所述PCI总线和第二设备之间通信的预设内容;

DSP模块,用于根据所述预设内容实现所述异步总线和所述PCI总线、所述异步总线和第一设备或者所述PCI总线和第二设备之间的通信。

在本发明的一个实施例中,还包括16个第一电阻和若干第二电阻,所述DSP模块包括16个数据线引脚、若干地址线引脚,其中,

每个所述数据线引脚对应连接一所述第一电阻的第一端,所述第一电阻的第二端对应连接至所述PCI总线的数据线,每个所述地址线引脚对应连接一所述第二电阻的第一端,所述第二电阻的第二端对应连接至所述PCI总线的地址线。

在本发明的一个实施例中,还包括若干第三电阻,所述DSP模块还包括2个第一片选信号引脚、2个第一字节使能信号引脚、第一使能信号引脚、第一读使能信号引脚、第一写使能信号引脚和第一数据收发准备信号引脚,其中,

所述第一片选信号引脚、所述第一字节使能信号引脚、所述第一使能信号引脚、所述第一读使能信号引脚和所述第一写使能信号引脚分别连接一第三电阻的第一端。

在本发明的一个实施例中,还包括四个第四电阻和若干第五电阻,其中,

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