[发明专利]一种基于DSP的总线控制电路有效

专利信息
申请号: 201911421722.3 申请日: 2019-12-31
公开(公告)号: CN111209235B 公开(公告)日: 2023-03-21
发明(设计)人: 宋杰;夏杰;李凯;赵江涛;陈飞茹;任欢 申请(专利权)人: 西安翔腾微电子科技有限公司
主分类号: G06F13/38 分类号: G06F13/38;G06F13/10
代理公司: 西安嘉思特知识产权代理事务所(普通合伙) 61230 代理人: 王海栋
地址: 710065 陕西省西*** 国省代码: 陕西;61
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摘要:
搜索关键词: 一种 基于 dsp 总线 控制电路
【权利要求书】:

1.一种基于DSP的总线控制电路,其特征在于,包括DSP模块、固化模块,固化模块、异步总线和PCI总线均连接至所述DSP模块,其中,

FLASH模块,用于固化所述异步总线和所述PCI总线、所述异步总线和第一设备或者所述PCI总线和第二设备之间通信的预设内容;

DSP模块,用于根据所述预设内容实现所述异步总线和所述PCI总线、所述异步总线和第一设备或者所述PCI总线和第二设备之间的通信;

还包括16个第一电阻和若干第二电阻,所述DSP模块包括16个数据线引脚、若干地址线引脚,其中,

每个所述数据线引脚对应连接一所述第一电阻的第一端,所述第一电阻的第二端对应连接至所述PCI总线的数据线,每个所述地址线引脚对应连接一所述第二电阻的第一端,所述第二电阻的第二端对应连接至所述PCI总线的地址线;

还包括若干第三电阻,所述DSP模块还包括2个第一片选信号引脚、2个第一字节使能信号引脚、第一使能信号引脚、第一读使能信号引脚、第一写使能信号引脚和第一数据收发准备信号引脚,其中,

所述第一片选信号引脚、所述第一字节使能信号引脚、所述第一使能信号引脚、所述第一读使能信号引脚和所述第一写使能信号引脚分别连接一第三电阻的第一端;

还包括四个第四电阻和若干第五电阻,其中,

与所述第一使能信号引脚、所述第一读使能信号引脚和所述第一写使能信号引脚连接的所述第三电阻的第二端均对应连接一所述第四电阻的第一端,所述第一数据收发准备信号引脚连接一所述第四电阻的第一端,所述第四电阻的第二端连接电压源端,每一所述第五电阻的第一端对应连接一所述第二电阻的第二端,所述第五电阻的第二端连接接地端;

还包括若干第一电容、第六电阻和三个第七电阻,所述FLASH模块包括若干第一引脚、若干第二引脚、第二使能信号引脚、第二写使能信号引脚、第二字节使能信号引脚、第二片选信号引脚和电压源引脚,其中,

每个所述第一引脚对应连接一所述第一电阻的第二端,每个所述第二引脚对应连接一所述第二电阻的第二端,所述第二使能信号引脚、所述第二写使能信号引脚对应连接所述DSP模块的所述第一使能信号引脚、所述第一写使能信号引脚,所述第二片选信号引脚对应连接所述DSP模块的其中一个所述第一片选信号引脚,所述若干第一电容并接于所述电压源引脚和接地端之间,所述第六电阻连接于所述第二字节使能信号引脚和接地端之间,所述三个第七电阻的第一端分别连接所述第二写使能信号引脚、第二片选信号引脚和所述DSP模块的另外一个所述第一片选信号引脚,所述三个第七电阻的第二端连接电压源端。

2.根据权利要求1所述的基于DSP的总线控制电路,其特征在于,还包括晶振、EMC滤波器、第八电阻、第九电阻、若干第二电容,所述DSP模块还包括时钟信号输入引脚和供电电源引脚,其中,

所述第八电阻连接于所述时钟信号输入引脚和所述晶振的第一端之间,所述晶振的第二端连接接地端,所述晶振的第三端连接所述第九电阻的第一端,所述九电阻的第二端和所述晶振的第四端连接电压源端;

所述供电电源引脚连接所述若干第二电容并接的第一端,所述供电电源引脚还连接所述EMC滤波器的第一端,所述EMC滤波器的第二端连接电压源端,所述EMC滤波器的第三端和所述若干第二电容并接的第二端共同连接接地端。

3.根据权利要求1所述的基于DSP的总线控制电路,其特征在于,还包括若干第十电阻,所述DSP模块还包括11个第三引脚、若干第四引脚和若干地址数据线复用引脚,其中,

所述11个第三引脚分别连接所述PCI总线的INTA引脚、FRAME引脚、DEVSEL引脚、STOP引脚、TRDY引脚、PERR引脚、SERR引脚、IRDY引脚、REQ引脚、GNT引脚、RST引脚,所述若干第四引脚分别连接所述PCI总线的第三字节使能信号,所述若干地址数据线复用引脚连接所述PCI总线的地址数据复用线,所述11个第三引脚和所述若干第四引脚分别连接一所述第十电阻的第一端,所述第十电阻的第二端连接所述电压源端。

4.根据权利要求1所述的基于DSP的总线控制电路,其特征在于,还包括电源模块,所述电源模块连接所述DSP模块,用于向所述DSP模块提供电源。

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