[发明专利]基于FPGA的不同时间同步信号自选择输入装置在审
| 申请号： | 201911390768.3 | 申请日： | 2019-12-30 |
| 公开（公告）号： | CN110944019A | 公开（公告）日： | 2020-03-31 |
| 发明（设计）人： | 陈建平;吴龟灵;胡亮 | 申请（专利权）人： | 嘉兴泰传光电有限公司 |
| 主分类号： | H04L29/06 | 分类号： | H04L29/06 |
| 代理公司： | 上海恒慧知识产权代理事务所(特殊普通合伙) 31317 | 代理人： | 张宁展 |
| 地址： | 314200 浙江省嘉兴市平*** | 国省代码： | 浙江;33 |
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| 摘要： | |||
| 搜索关键词： | 基于 fpga 不同 时间 同步 信号 选择 输入 装置 | ||
【权利要求书】：
1.一种基于FPGA的不同时间同步信号自选择输入装置，其特征在于，在同一块板卡上设置包括FPGA主处理模块、IRIG-B码时间信号输入模块、E1码时间信号输入模块、上级服务器TOD时间信号输入模块，GNSS时间信号输入模块、PTP时间信号输入模块、NTP时间信号输入模块和上位机通讯模块，所述的IRIG-B码时间信号输入模块、E1码时间信号输入模块、上级服务器TOD时间信号输入模块，GNSS时间信号输入模块、PTP时间信号输入模块、NTP时间信号输入模块和上位机通讯模块分别与FPGA主处理模块相连，所述的FPGA主处理模块接受上位机通讯模块对输入模式选择和优先级的设置，所述的IRIG-B码时间信号输入模块、E1码时间信号输入模块、上级服务器TOD时间信号输入模块，GNSS时间信号输入模块、PTP时间信号输入模块、NTP时间信号输入模块分别接收对应外部时间信号并输入所述的FPGA主处理模块，所述的FPGA主处理模块将各模块输入的时间信息解码后，进行排序处理，存入相应的寄存器中。
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