[发明专利]多芯片闭环通信延迟计算方法、通信同步方法及通信系统有效

专利信息
申请号: 201911213075.7 申请日: 2019-12-02
公开(公告)号: CN110995537B 公开(公告)日: 2023-02-03
发明(设计)人: 刘德高;熊源;刘益;谭清奎;郎飞;郑立兴;唐彦杰 申请(专利权)人: 重庆矢崎仪表有限公司
主分类号: H04L43/0852 分类号: H04L43/0852;H04L67/12;H04L7/00
代理公司: 重庆市前沿专利事务所(普通合伙) 50211 代理人: 郭云
地址: 401123 重*** 国省代码: 重庆;50
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摘要:
搜索关键词: 芯片 闭环 通信 延迟 计算方法 同步 方法 系统
【权利要求书】:

1.一种多芯片闭环通信延迟计算方法,其中多芯片包括任务发送芯片和任务响应芯片,其特征在于,包括以下步骤:

D1,任务发送芯片向任务响应芯片发送握手信号,所述握手信号包括第一时间戳;任务响应芯片接收握手信号后,记录第二时间戳,并返回握手应答信号至任务发送芯片;任务发送芯片接受到握手应答信号后,记录第三时间戳;

D2,任务响应芯片接收握手信号后,根据第一时间戳和第二时间戳计算从任务发送芯片至任务响应芯片的半程通信延迟时间;任务发送芯片接受到握手应答信号后,根据第一时间戳和第三时间戳计算任务发送芯片从发送到接收握手应答信号的全程通信延迟时间;

D3,生成延迟数据表,所述延迟数据表的字段包括,任务发送芯片、任务响应芯片、存储的数据是通信延迟时间,所述通信延迟时间为半程通信延迟时间或全程通信延迟时间;

所述延迟数据表内的字段还包括通信线路;

所述延迟数据表内的字段还包括任务类型,所述任务类型用于表示芯片执行任务时运行程序的耗时时间。

2.一种多芯片闭环通信同步方法,其特征在于,包括以下步骤:

S1,通过权利要求1所述的多芯片闭环通信延迟计算方法计算获得延迟数据表,在多芯片协力计算过程中,根据延迟数据表确定芯片的延迟时间,进行任务的延时处理。

3.根据权利要求2所述的多芯片闭环通信同步方法,其特征在于,还包括步骤S2,根据运行时采集的实时通信延迟时间和/或程序运行时间调整延迟数据表内的通信延迟时间和/或程序设计延迟时间。

4.根据权利要求3所述的多芯片闭环通信同步方法,其特征在于,所述步骤S2中采用限制最大步进逼近算法或PID等算法,来调整通信延迟时间和/或程序设计延迟时间。

5.一种多芯片闭环通信系统,其特征在于,包括外部信号源、两个以上的芯片,用于执行权利要求2-4任一所述通信同步方法;外部信号源和芯片之间依次串联;外部信号源的信号通过导线分别传输至各芯片;各芯片之间通过任务数据传输线和时间传输线连接。

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