[发明专利]GOA电路及显示装置有效

专利信息
申请号: 201910967103.8 申请日: 2019-10-12
公开(公告)号: CN110767189B 公开(公告)日: 2022-03-08
发明(设计)人: 奚苏萍 申请(专利权)人: 深圳市华星光电半导体显示技术有限公司
主分类号: G09G3/36 分类号: G09G3/36
代理公司: 深圳翼盛智成知识产权事务所(普通合伙) 44300 代理人: 杨瑞
地址: 518132 广东省深*** 国省代码: 广东;44
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摘要:
搜索关键词: goa 电路 显示装置
【权利要求书】:

1.一种GOA电路,其特征在于,包括级联设置的多个GOA单元,其中第n级GOA单元包括上拉控制电路、上拉电路、下拉电路、下拉维持电路、信号转换电路,所述n为正整数;

其中,所述上拉控制电路包括第一时钟信号输入端、第n级扫描驱动信号输入端、级传信号输入端以及上拉控制信号输出端,所述上拉电路与所述上拉控制信号输出端耦接于第一公共点,所述下拉电路耦接所述第一公共点、所述第n级扫描驱动信号输出端、所述下拉维持电路以及直流低压信号输入端,所述信号转换电路耦接所述第一时钟信号输入端和所述直流低压信号输入端;

所述上拉控制电路包括第一薄膜晶体管、第二薄膜晶体管和第三薄膜晶体管,所述第一薄膜晶体管的栅极和所述第二薄膜晶体管的栅极耦接所述级传信号输入端,所述第一薄膜晶体管的源极耦接所述级传信号输入端,所述第一薄膜晶体管的漏极与所述第二薄膜晶体管的源极以及所述第三薄膜晶体管的漏极耦接于第一节点,所述第二薄膜晶体管的漏极耦接所述上拉控制信号输出端,所述第三薄膜晶体管的栅极耦接所述第一时钟信号输入端,所述第三薄膜晶体管的源极耦接所述第n级扫描驱动信号输入端;

所述GOA电路的信号输入输出时序包括:

在第一时段内,第n级扫描驱动信号为高电位,第一时钟信号为高电位,级传信号为低电位;

在第二时段内,第n级扫描驱动信号为低电位,第一时钟信号为低电位,级传信号为低电位;

在第三时段内,第n级扫描驱动信号保持低电位,级传信号保持低电位,第一时钟信号持续规律的高低电位的变化。

2.如权利要求1所述的GOA电路,其特征在于,当1≤n≤4时,所述级传信号输入端输入一初始信号,所述上拉控制电路根据所述初始信号、第一时钟信号以及第n级扫描驱动信号输出上拉控制信号;当n>4时,所述级传信号输入端输入第n-4级GOA单元输出的第n-4级级传信号,所述上拉控制电路根据所述第n级扫描驱动信号、所述第一时钟信号以及所述第n-4级级传信号输出所述上拉控制信号。

3.如权利要求1所述的GOA电路,其特征在于,所述上拉电路包括第四薄膜晶体管,所述第四薄膜晶体管的栅极耦接第一公共点,所述第四薄膜晶体管的源极耦接所述第一时钟信号输入端,所述第四薄膜晶体管的漏极耦接所述第n级扫描驱动信号输出端。

4.如权利要求3所述的GOA电路,其特征在于,所述信号转换电路包括第五薄膜晶体管,所述第五薄膜晶体管的栅极耦接所述直流低压信号输入端,所述第五薄膜晶体管的源极耦接所述第一时钟信号输入端,所述第五薄膜晶体管的漏极耦接第n级级传信号输出端。

5.如权利要求1所述的GOA电路,其特征在于,所述下拉电路耦接第n+4级扫描驱动信号输入端,并根据第n+4级扫描驱动信号和直流低压信号下拉所述上拉控制信号和所述第n级扫描驱动信号。

6.如权利要求5所述的GOA电路,其特征在于,所述下拉电路包括第六薄膜晶体管、第七薄膜晶体管、第八薄膜晶体管和第九薄膜晶体管,所述直流低压信号输入端包括第一直流低压信号输入端和第二直流低压信号输入端;

所述第六薄膜晶体管的栅极与第七薄膜晶体管的栅极以及第八薄膜晶体管的栅极耦接所述第n+4级扫描驱动信号输入端,所述第六薄膜晶体管的源极耦接所述第一直流低压信号输入端,所述第六薄膜晶体管的漏极耦接所述第n级扫描驱动信号输出端,所述第七薄膜晶体管的漏极耦接所述第一公共点,所述第七薄膜晶体管的源极耦接所述第九薄膜晶体管的漏极以及所述第八薄膜晶体管的漏极,所述第八薄膜晶体管的源极耦接所述第二直流低压信号输入端,所述第九薄膜晶体管的源极耦接所述下拉维持电路。

7.如权利要求1所述的GOA电路,其特征在于,所述下拉维持电路包括第一下拉维持电路和第二下拉维持电路,所述第一下拉维持电路和所述第二下拉维持电路交替起作用,将所述上拉控制信号和所述第n级扫描驱动信号维持在关闭状态。

8.如权利要求1所述的GOA电路,其特征在于,所述第n级GOA单元还包括自举电容,所述自举电容耦接于所述第一公共点与所述第n级扫描驱动信号输出端之间。

9.一种显示装置,其特征在于,包括如权利要求1至8任一项所述的GOA电路。

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